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  1. FPGA控制AD程序,ADC,DAC转换接口

    2下载:
  2. FPGA控制AD程序,ADC,DAC转换接口.rar 有限状态机控制AD采样.rar,FPGA control AD procedure
  3. 所属分类:VHDL编程

    • 发布日期:2016-12-23
    • 文件大小:262.8kb
    • 提供者:黄群
  1. ispLEVER是LATTICE的CPLD、FPGA继承开发环境

    2下载:
  2. ispLEVER是LATTICE的CPLD、FPGA继承开发环境,ISPLEVER许可文件--ISPLEVER6.0-7.1的注册机,ispLEVER is LATTICE of CPLD, FPGA development environment succession, ISPLEVER license file- ISPLEVER6 .0-7.1 the Zhuceji
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-24
    • 文件大小:265kb
    • 提供者:陈荣
  1. 用FPGA实现SRAM读写控制的Verilog代码

    1下载:
  2. 用FPGA实现SRAM读写控制的Verilog代码-SRAM FPGA implementation using Verilog code to read and write control
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:13.39kb
    • 提供者:austin
  1. RS232串口通信协议

    0下载:
  2. RS232串口通信协议,verilog实现,通过FPGA完全调通。,RS232 serial communication protocol, verilog achieved entirely through the FPGA transfer pass.
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:3.45kb
    • 提供者:dingsheng
  1. 在六个数码管滚动显示自己的学号(六位)

    0下载:
  2. 在六个数码管滚动显示自己的学号(六位),每隔一定时间循环移位一次,学号为奇数则左移,学号为偶数则右移。间隔时间可由开关选择1秒,2秒,3秒和4秒。-In the six LED scrolling display their student number (six), rotate once every certain period of time, learning number is odd, then the left, student number is even, then the r
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:365kb
    • 提供者:
  1. 直流电机的verilog hdl 代码

    0下载:
  2. 直流电机的verilog hdl 代码,适合初学者参考,DC motor verilog hdl code, suitable for beginners reference
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-17
    • 文件大小:4.8mb
    • 提供者:黄涛
  1. 基于verilog HDL语言的电子钟

    0下载:
  2. 基于verilog HDL语言的电子钟,多功能电子时钟,Verilog HDL language-based electronic bell, electronic multi-function clock
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-28
    • 文件大小:180.74kb
    • 提供者:哈哈
  1. 开源软核处理器OpenRisc的SOPC设计

    1下载:
  2. 开源软核处理器OpenRisc的SOPC设计,开源软核处理器OpenRisc的SOPC设计
  3. 所属分类:VHDL编程

    • 发布日期:2015-09-19
    • 文件大小:764.96kb
    • 提供者:邓宜宾
  1. verilog 128位 突发4. sdr fpga控制器

    0下载:
  2. verilog 128位 突发4. sdr fpga控制器,verilog 128 bit unexpected 4. sdr fpga controller
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-24
    • 文件大小:117.16kb
    • 提供者:pudnrtest
  1. VHDL多功能时钟设计

    0下载:
  2. VHDL多功能时钟设计~~24小时制~带闹钟,VHDL design of multi-functional clock ~ ~ ~ 24 hours with alarm system
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-25
    • 文件大小:80.82kb
    • 提供者:jecky
  1. csa3

    0下载:
  2. carry save adder block3
  3. 所属分类:VHDL编程

    • 发布日期:2012-08-28
    • 文件大小:777byte
    • 提供者:siva
  1. 用Verilog语言实现QPSK调制

    3下载:
  2. 用Verilog语言实现QPSK调制,QPSK是一种数字调制方式。它分为绝对相移和相对相移两种。 -Verilog language using QPSK modulation, QPSK is a digital modulation. It is divided into absolute and relative phase shift of the phase shift of two.
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-06
    • 文件大小:799byte
    • 提供者:陈华
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