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  1. 08_motor

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  2. motor interfacing with fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:312.75kb
    • 提供者:uzair
  1. 7segment

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  2. 使用DE2开发板进行数码管和LED灯控制程序,利用18个拨码开关控制18个红色LED灯并控制数码管显示。-DE2 performed using digital control and LED light control procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:267.51kb
    • 提供者:lizhensong
  1. 32bitvhdl

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  2. 基于硬件描述语言的通过加法器实现的32位乘法器-Hardware descr iption language implemented by the adder 32 of the multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.46kb
    • 提供者:gengzhans
  1. BPSK

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  2. 在quartues ii环境下编译的M序列码的BPSK调制-BPSK modulation compiler environment under quartues ii M-sequence code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.67mb
    • 提供者:lhd
  1. xinhaofashengqi

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  2. 信号发生器,可产生多种信号,频率相位可自由控制-Signal generator, can produce a variety of signals, the frequency can be freely controlled phase
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.72mb
    • 提供者:zhongjian
  1. mod_demod

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  2. 用matlab仿真4FSK调制 包括一个SRRC滤波器 一个3级CIC滤波器-realize 4FSK modulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:416.72kb
    • 提供者:华惟哲
  1. FPGA-chaoshengbo-

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  2. fpga 超声波测试 verilog源码,测试可用,也可当参考-fpga verilog source of ultrasonic testing, the test is available, it can be used as a reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:416.97kb
    • 提供者:徐松
  1. 2014-4-23

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  2. 正弦信号发生器,rom78需要自己设置。请参考其他资料-Sinusoidal signal generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:5.17kb
    • 提供者:王柳
  1. run_led

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  2. Xilinx FPGA, ISE工程文件,Verilog语言实现流水灯,设计了分频器,可精确到点亮时间为一秒,可控制流水灯左右移位方向-Xilinx FPGA, ISE project file, Verilog language water lights, designed divider, accurate to one second light time, you can control the direction of light water left shift
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:296.82kb
    • 提供者:zy
  1. arbiter2

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  2. The logic design of an efficient and fast round robin arbiter in Verilog or any other HDL language relies on the capability to find the next requestor to grant without losing cycles and with minimal logical stages. Using the fastest logic constructs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:725byte
    • 提供者:thanh
  1. Verilog-interface

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  2. 基于fpga的verilog语言 实现的串口接收发送数据编程-fpga serial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.01kb
    • 提供者:时迁
  1. Verilog

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  2. 使用verilog编写的各种例程 从简单到复杂应有尽有-Use a variety of routines written in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.74mb
    • 提供者:时迁
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