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  1. finalcoursework

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  2. 用VHDL代码写的模拟微处理器核程序,有计算模块和register file 等模块,并包含测试程序,调试程序 ACTIVE HDL-Simulation with the VHDL code is written in the microprocessor core procedures, such as computing modules, and register file module, and includes test program, the debugger ACTIVE HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:41.83kb
    • 提供者:三木
  1. lcd_drv

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  2. lcd driver 16x2 to drive lcd dispaly on altera de2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:2.14kb
    • 提供者:jan
  1. Verilog-HDL

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  2. Verilog-HDL实践与应用系统设计-Verilog-HDL Practice and Application System Design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-03
    • 文件大小:14.72mb
    • 提供者:李秀艳
  1. 7seg-led

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  2. VHDL的彩灯程序,内含数码管和led灯的显示,按照各种循环方式一次显示-The Lantern VHDL program, containing the digital pipe and led lights are displayed, according to a variety of recycling methods show once again that
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17.01kb
    • 提供者:liwx
  1. frequency_meter

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  2. 简易频率计,能够测试0~10000KHz之间的脉冲信号频率,并显示在数码管上。利用了100KHz的脉冲作为基准信号。包含课程设计报告。-Simple frequency meter, to test pulses between 0 ~ 10000KHz signal frequency and displays in the digital pipe. Use 100KHz pulse as a reference signal. Includes curriculum design repo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:12.49kb
    • 提供者:石帆
  1. cordic_lattice

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  2. lattice implementation of pot with cordic algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:558.92kb
    • 提供者:park sang yoon
  1. bch

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  2. Experimental report VHDL VHDL verilog rs flip-flop experiment experimental report VHDL VHDL verilog rs flip-flop experiment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:15.09kb
    • 提供者:santhu
  1. dac8143

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  2. Digital to Analog Converter Model for Analog Devices part DAC 8143.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:960byte
    • 提供者:salman
  1. ads7809

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  2. VHDL model file for Analog devices Analog to Digital converter model ADC7809.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:978byte
    • 提供者:salman
  1. fifo64x8_tb

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  2. Testbench for Xilinx 64x8 FIFO.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:733byte
    • 提供者:salman
  1. demux

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  2. 与多工器功能相反,可将一个位元的资料透过选择分配输出端的其中一个。 -In contrast with the multiplexer function can be a bit of information on the allocation of the output by selecting one of them.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.32kb
    • 提供者:李宗晟
  1. shouhuoji

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  2. 用Verilog语言实现自动售货机,外加实现课件-Automatic vending machines with the Verilog language, along with realization of courseware
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:648.96kb
    • 提供者:万小中
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