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  1. OV7725

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  2. OV7725初始化源代码,已经通过工程实践的验证完全没问题。-this is the initialization code of OV7725 and is verified by engineer in the corporation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:5.12kb
    • 提供者:郭小兵
  1. PS2-keyboard

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  2. DE2-115实现键盘输入显示在lcd显示屏-DE2-115 keyboard input and show in the lcd
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3.51mb
    • 提供者:Wang Yibing
  1. 一个非标项目的原型设计

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  2. 以前做的一个项目的架构原型,labview做的,也希望大家提意见,跟大家一起分享进步
  3. 所属分类:VHDL编程

  1. 2

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  2. 基于状态机的交通灯控制 交通灯初始状态为红灯,交通灯工作过程依次是红绿黄宏,黄灯3s,红灯9s,绿灯6s。-Traffic light control based on state machine Traffic lights initial state is red, traffic lights work process is followed by red and green yellow macro, yellow 3s, red 9s, green 6s.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:559.12kb
    • 提供者:虫虫喵
  1. BC-ADDRESS

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  2. B61580 1553B BC模式配置地址-B61580 1553B BC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:954byte
    • 提供者:ye
  1. BC-DATA

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  2. B61580 1553B BC模式配置数据-B61580 1553B BC data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:790byte
    • 提供者:ye
  1. dds

    0下载:
  2. FPGA产生dds正弦信号,基于quartus-FPGA generate dds sine signal, based on quartus
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.89mb
    • 提供者:谢松伯
  1. pid-controller-report

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  2. The Laplace transform is an integral transform perhaps second only to the Fourier transform in its utility in solving physical problems. The Laplace transform is particularly useful in solving linear ordinary differential equations such as those aris
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:806.15kb
    • 提供者:Maddy
  1. STM32ra8875

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  2. 通过ARM控制基于RA8875的触摸屏-Through the ARM control based on the RA8875 touch screen. . . . . . . . . .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:858.92kb
    • 提供者:lerning dog
  1. eda

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  2. eda语言学习代码,基础内容辅导与设计,学习eda必备,有效缩短学习时间-eda language learning code, basic content and design counseling, learning eda necessary, shorten the learning time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.42mb
    • 提供者:guo
  1. Dpsk

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  2. DPSK数字psk设计,matlab仿真设计,fpga实现-DPSK digital psk design, matlab simulation design, fpga realization
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:5.99mb
    • 提供者:吢呈
  1. RAM

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  2. 用verilog实现了IP核的使用,例化了一个RAM,用来进行读写操作,另外还编写了斐波那契数列来进行测试。-Using verilog to achieve the use of IP core, the instantiation of a RAM, used to read and write operations, in addition to the preparation of the Fibonacci sequence for testing.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.55kb
    • 提供者:east
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