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  1. alucode

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  2. the code is written to perform an ALU operation which is implemented in fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.35kb
    • 提供者:yeshoda
  1. zuoye3

    0下载:
  2. 实现数码管扫描显示控制器 实现循环显示,一次移动,单个显示-digital tube show vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:802byte
    • 提供者:xu hao
  1. booth.txt

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  2. the code performs the booth multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:860byte
    • 提供者:yeshoda
  1. fir_16.txt

    0下载:
  2. the code performs the fir 16 tap filter operation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.26kb
    • 提供者:yeshoda
  1. EDA

    0下载:
  2. 基于EDA技术的八路智力抢答器的设计,原理图和VHDL程序-based on EDA technology, intellectual Responderbased on EDA technology, intellectual answering device design, process schematics and VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:375.56kb
    • 提供者:何乐
  1. 2440_FPGA

    0下载:
  2. 在三星2440基础上扩展FPGA,实现多串口通讯的FPGA源码。编译、验证完全正确,放心使用,是不可多得的实用资料!-Based on the expansion of the Samsung 2440 FPGA, FPGA implementation of serial communication source. Compile, verify completely correct, ease of use, is a rare practical information!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.47mb
    • 提供者:周明
  1. ad0809

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  2. ADC0809 verilog-ADC0809 verilog...............................
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:815byte
    • 提供者:Tao
  1. UART

    0下载:
  2. 本模块的功能是验证实现和PC机进行基本的串口通信的功能。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.86kb
    • 提供者:姜昕
  1. FIFOadnVHDL

    0下载:
  2. FIFO (先进先出队列)是一种在电子系统得到广泛应用的器件,通常用于数据的缓存和用于容纳异步信号的频率或相位的差异。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:2.53kb
    • 提供者:姜昕
  1. RAMANDVHDL

    0下载:
  2. 双接口的RAM的VHDL,用VHDL语言编写的
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:915byte
    • 提供者:姜昕
  1. adder_32

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  2. 32bits 加法器-32bits adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:614byte
    • 提供者:aguang
  1. CLZ_32bit

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  2. 前导零的计算-Calculation of leading zeros
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:996byte
    • 提供者:aguang
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