CDN加速镜像 | 设为首页 | 加入收藏夹
当前位置: 首页 源码下载 嵌入式/单片机编程 VHDL编程

资源列表

« 1 2 ... .28 .29 .30 .31 .32 3733.34 .35 .36 .37 .38 ... 4323 »
  1. 32bits_COLOR_LED_AHDL_CODE

    0下载:
  2. 用於32位色控制的LED大屏幕的AHDL代碼-For 32-color large screen LED control of AHDL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:383.89kb
    • 提供者:鄧志明
  1. watch

    0下载:
  2. 2个按键的跑表,一个是开始停止,一个复位-Two of the stopwatch button, one is stopped, a reset
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:66.79kb
    • 提供者:张锦鹏
  1. VerilogHDL-huawei

    0下载:
  2. Verilog HDL 华为入门教程.pdf 内部资料-Verilog HDL Tutorial Huawei. Pdf internal information
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:256.78kb
    • 提供者:李天
  1. leon3

    0下载:
  2. leon3 source code 虽然gaisler网站上有下载,但是提供此代码,希望能与更多的朋友一起学习leon-leon3 source code although gaisler website to download, but the provision of this code, would like to work with more friends with learning leon
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:141.05kb
    • 提供者:CGF
  1. VHDL

    0下载:
  2. 电子抢答器VHDL语言设计 材料是一图文格式的可能需要读者自己打上去 不过绝对真实-Answer electronic device materials VHDL language design is a graphic format, the reader may need to play up its own absolutely true, however
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.73mb
    • 提供者:陈明
  1. internet_FPGA

    0下载:
  2. 介绍了Xilinx最新的EDK9.1i和ISE9.1i等工具的设计使用流程-Xilinx introduced the latest EDK9.1i and ISE9.1i the use of tools such as the design process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:140.09kb
    • 提供者:伍迪
  1. srbjq

    0下载:
  2. vhdl实现的三人表决器,大家一起交流一下,-VHDL realization of three voting machines and we can work together to exchange about
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.11kb
    • 提供者:孟旭
  1. StateMachine

    0下载:
  2. 典型的状态机,简单的状态机可以不需要编码,也可以采用one-hot编码方式,如果状态很多时,采用格雷码,能有效避免亚稳态。-A typical state machine, a simple state machine can do without coding, can also be used one-hot encoding, if the state in many cases, the use of Gray code, can effectively avoid metastable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.06kb
    • 提供者:吴长瑞
  1. l2woM1Nz

    0下载:
  2. 一些比较实用的例子,希望能给大家带来帮助。-Some more practical examples, we hope that they will be helpful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:492.91kb
    • 提供者:晓贞
  1. Bluetooth

    0下载:
  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:12.77kb
    • 提供者:lijun
  1. AVR_Core

    0下载:
  2. AVR_Core IP CORE .VERY GOOD AS A STUDY FILE-AVR_Core IP CORE. VERY GOOD AS A STUDY FILE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:68.38kb
    • 提供者:lijun
  1. Embedded_risc

    0下载:
  2. Embedded_risc IP CORE .VERY GOOD AS A STUDY FILE-Embedded_risc IP CORE. VERY GOOD AS A STUDY FILE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:124.43kb
    • 提供者:lijun
« 1 2 ... .28 .29 .30 .31 .32 3733.34 .35 .36 .37 .38 ... 4323 »
搜珍网 www.dssz.com