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  1. rs232

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  2. RS232的串口控制器,本程序中的每个小模块都有与之对应的testbench,模块清晰,实现结构简单。很适合Verilog编程初学者来练习!-RS232 serial port controller, the program has a small module for each corresponding testbench, module definition, to achieve simple structure. Verilog programming is suitable for
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:409.37kb
    • 提供者:veriman
  1. video

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  2. 用VHDL实现视频控制程序,包含详细的实现代码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:409.38kb
    • 提供者:王刚
  1. FFT_VHDl

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  2. VHDL实现快速傅里叶变换,内附带资料以及源代码。-VHDL fast Fourier transform, within the supplied data and source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:409.42kb
    • 提供者:eric
  1. fft

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  2. 16卫浮点FFT算法的VHDL实现,有测试文件。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:409.44kb
    • 提供者:付少锋
  1. Tutorial5

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  2. Xilinx FPGA tutorial 5
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:409.44kb
    • 提供者:Rafaeleg
  1. Risc128

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  2. 128 bit RISC processor implementation in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:409.45kb
    • 提供者:prasanth
  1. PS2

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  2. ps2键盘连接口程序,通过键盘控制开发板的数码管显示字符。-ps2 keyboard connector program, display characters from the keyboard to control the development of the digital board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:409.51kb
    • 提供者:夏休休
  1. gpio-master

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  2. 基于WISHBONE总线接口的GPIO模块verilog代码实现,包含详细GPIO定义文档,testbench,RTL仿真与综合环境-WISHBONE interface to GPIO verilog code, GPIO define, RTL sim, syn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:409.55kb
    • 提供者:lv
  1. serial

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  2. 实现了一个串口功能,用Verilog语言写的,可作为IP使用-Implements a serial port function, written using Verilog language can be used as an IP
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:409.64kb
    • 提供者:hongfeng
  1. DSPwithFPGAfiles

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  2. Accompanying files for DSP with FPGA book.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:409.65kb
    • 提供者:_Aquarius_
  1. EDAplvj

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  2. 4挡频率及设计 用于测量制定信号的频率 Verilog语言编写-4 block design used to measure the frequency and the frequency of the signal developed Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:409.73kb
    • 提供者:沈小响
  1. 0133

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  2. 实现电子时钟功能,能够设置时间,最大时间精确度为0.01s-eletronic clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:409.82kb
    • 提供者:zy
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