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  1. DeathRoad

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  2. traffic light controller.-traffic light controller.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:592.37kb
    • 提供者:nahum
  1. text1

    0下载:
  2. 单片机和fpga通信,fpga向单片机中写数据,写依次增大的数据-Communication microcontroller and fpga, fpga write data to the microcontroller, in turn increasing the data write
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:592.37kb
    • 提供者:houzhengtao
  1. 225

    0下载:
  2. SIGMA DELTA MODULATOR
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:592.44kb
    • 提供者:jack
  1. tutorial

    0下载:
  2. Tutorial vhdl cronometro
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:592.46kb
    • 提供者:tor
  1. tutorialaaaa

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  2. practice tutorial about language vhdl its very practice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:592.48kb
    • 提供者:paredes_47
  1. FPGA

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  2. 基于FPGA的通信系统调制解调,包括理论知识介绍和VHDL程序。包含2ASK ,2FSK,2PSK -FPGA-based modem communication systems, including the introduction of theoretical knowledge and the VHDL program. Contains 2ASK, 2FSK, 2PSK
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-05
    • 文件大小:592.65kb
    • 提供者:songlina
  1. prelim_e_lib

    0下载:
  2. Very important document to understand SPECMAN E Language and its library
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:592.69kb
    • 提供者:ABRAXAS
  1. w

    0下载:
  2. VHDL编写的一个简单的数码管扫描电路程序-VHDL prepared a simple digital scanning circuit program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:592.98kb
    • 提供者:基哥
  1. UART

    0下载:
  2. VHDL编写的FPGA串口与电脑通信-Written in VHDL FPGA serial communication with the computer ..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:593.22kb
    • 提供者:island
  1. vga8

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  2. 利用FPGA设计VGA控制器,实现彩框显示 -Use FPGA design VGA controller, realize the color box display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:593.22kb
    • 提供者:王前
  1. proyecto

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  2. proyecto en vhdl, xilinx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:593.29kb
    • 提供者:kikexx
  1. mem_wb

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  2. 采用Verilog编写的存储器,使用lpm_ram_dq模拟主存。主要内容为实现了存储器的奇偶分体,使得该存储器可以进行字或字节的读写操作。-Written by Verilog memory, use lpm_ram_dq simulated main memory. The main content of the memory parity split making the memory word or byte read and write operations.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:593.33kb
    • 提供者:Blueve
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