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  1. UART_VHDL

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  2. URAT异步通信接口的VHDL描述,可综合
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:652.74kb
    • 提供者:luyingc
  1. dianti

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  2. 用verilog写的电梯控制器内附测试文件和实验报告 -Use verilog to write elevator controller with the test documentation and test reports
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-07-06
    • 文件大小:652.77kb
    • 提供者:黎德才
  1. FPGASCH

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  2. FPGA学习板原理图,对于初学者来说很有用,免费下载
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:652.77kb
    • 提供者:chengjunzhao
  1. fivealterakaifabanziliao

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  2. 5款ALTERA FPGA开发板原理图合集 -5 ALTERA FPGA development board schematic Collection 5 ALTERA FPGA development board schematic Collection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:652.88kb
    • 提供者:水牛EDA
  1. verilogChapter-8

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  2. 续完chapter07,给出了从入门到工程应用的一些实例,可以帮助初学者通过学习实例了解和掌握硬件描述语言的基本知识。-Continued chapter07, from entry to the project are given some examples of applications that can help beginners learn instance by hardware descr iption language to understand and master the b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:653.15kb
    • 提供者:Alice Yang
  1. tst8

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  2. verilog编写的键盘接口程序,带串口测试-verilog prepared by the keyboard interface program with serial test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:653.17kb
    • 提供者:huanglei
  1. dpll

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  2. 基于Verilog的数字锁相环。包括三个模块,数字鉴相器DPD、数字环路滤波器DLF、数控振荡器 DCO三部分构成-Verilog-based digital PLL. Consists of three modules, the digital phase detector DPD, digital loop filter DLF, digitally controlled oscillator DCO three parts
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-27
    • 文件大小:653.2kb
    • 提供者:栾帅
  1. x86-micro-architecture

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  2. x86 micro architecture.rar
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:653.37kb
    • 提供者:roc
  1. sp3e_fifo

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  2. xilinx spartan3e fifo读写测试工程 仿真通过。全套工程。-xilinx spartan3e fifo read and write test engineering simulation through.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:653.39kb
    • 提供者:zzy
  1. IR

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  2. 利用verilog编写的红外线接收解码电路,开发环境为altera板,quartusII仿真并在开发板上验证通过-Prepared using verilog infrared receiver decoder circuit, the development environment for the altera board, quartusII simulation and validated by the development board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:653.52kb
    • 提供者:sjl
  1. 61EDA_D929

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  2. 控制两组,每组三个电梯的verilog实现-Control of two groups of three elevators Verilog realization of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:653.55kb
    • 提供者:吴奉
  1. ISE_lab10_fib

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  2. excd-1 斐波那契数列的实现 数码管的显示-excd-1 fib
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:653.63kb
    • 提供者:alex
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