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  1. TOP_WHIF_CAMRA_240_320

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  2. code in vhdl to frame_gerber form camera 320x240 pixle
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:730.33kb
    • 提供者:boazttt
  1. LPC post

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  2. 使用VHDL语言通过LPC接口实现的post卡功能,用于debug
  3. 所属分类:VHDL编程

  1. VHDLreportoftrafficlight.wps.tar

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  2. 该代码通过时钟,状态循环控制及显示模块实现了对于两相邻十字路*通灯到控制,同时包含了对于两路*通灯延时启动,以及人行道情况的考虑-The code of the clock, cycle control and display module status achieved for the two adjacent intersections to control traffic lights,and includes traffic light intersection for the tw
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:730.62kb
    • 提供者:
  1. he

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  2. 利用VHDL实现判向计数器,并且在数码管上实现显示。可以在XILINX开发板上实现对应功能,仿真也能实现。(The use of VHDL realize the counter counter, and in the digital tube to achieve display. The corresponding function can be implemented on the XILINX development board, and the simulation can also
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-11
    • 文件大小:730.77kb
    • 提供者:勿要归晚
  1. dttrytwo

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  2. 电梯控制器,可以实现多人多楼层上下的,用的verilog,板子basys2-elevator controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:730.84kb
    • 提供者:
  1. clock

    0下载:
  2. vhdl实现时钟和闹钟功能,此外还可以显示星期几,闹钟可以设置闹铃时间和报时。-implementation vhdl alarm clock and also can show a few weeks, you can set the alarm time and alarm time.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:730.87kb
    • 提供者:季全
  1. vhdlpicoblaze

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  2. This the design shipped with the board. The embedded PicoBlaze™ processor controller scrolls messages on the character LCD screen. The rotary pushbutton switch controls whether the switches or the rotary button controls the LEDs.-This is the des
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-22
    • 文件大小:731kb
    • 提供者:charlysed
  1. FPGAshiyan(3)

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  2. FPGA入门系列实验教程——实验三.LED流水灯-Getting Started Tutorial FPGA series of experiments- experiment III. LED water lamp
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:731.14kb
    • 提供者:lutangshi
  1. Lab1

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  2. xilinx培训资料,配合相应的PDF文件使用 共20个,先上传一部分,其他的有需要再上传-xilinx training materials, with the corresponding PDF file using a total of 20, first upload a part of, the other the need to re-upload
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:731.16kb
    • 提供者:周明
  1. DAC(tlv5616)

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  2. 本设计是基于EP4CE15F17C8N和TLV5616的12位DAC模数转换和12864显示的程序-The design is based on a program of 12 EP4CE15F17C8N and TLV5616 DAC analog to digital conversion and display of 12864
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:731.3kb
    • 提供者:
  1. chfqi

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  2. 简易5位乘法器的设计 用于EDA课程设计和VHDL的入门学习-Easy 5 Multiplier for EDA VHDL introduction to course design and learning
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:731.47kb
    • 提供者:沈小响
  1. Lab19Tetris

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  2. Lab19 俄罗斯方块Lab19 Tetris-Lab19 Lab19 Tetris Tetris
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:731.53kb
    • 提供者:廖杰
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