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  1. DF2C8_03_NixeTube

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  2. :8 个数码管从 0 开始计数,每次增加 1;每位显示的字符包括从 “0~F”16 个十六进制数;  按下复位按键之后,计数从 0 重新开始。由此可验证数码管、有 源时钟和复位按键等功能。-: 8 digital tube starts counting from 0, for each increase of 1 each displayed character from " 0 ~ F" 16 hexadecimal numbers press the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:715.16kb
    • 提供者:qiutian
  1. VHDL-multi-function-clock

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  2. 多功能时钟,包括一个时钟和一个秒表,可以互相切换并且不过中断各自的运行-a multi-function clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:715.08kb
    • 提供者:Chaowei Liu
  1. Lab3B

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  2. A Sequential Divider Design in VHDL -- homework in ASIC & FPGA Design cla-A Sequential Divider Design in VHDL-- homework in ASIC & FPGA Design class
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:715.06kb
    • 提供者:rusty
  1. learn_dds.基于quartus ii 9.0的简易dds波形发生器

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  2. 基于quartus ii 9.0的简易dds波形发生器,可以产生正弦,方波,三角波,可变幅,可变频。非常适合学习使用,使用时请按自己的芯片和引脚设置,Quartus ii 9.0 Based on dds simple waveform generator can produce sine, square, triangle wave can be amplitude, frequency can be. Very suitable for learning to use, when used
  3. 所属分类:VHDL编程

    • 发布日期:2016-04-29
    • 文件大小:714.97kb
    • 提供者:陈东旭
  1. Modelsim_How_to_use_pdf

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  2. Modelsim的使用方法,适合新手学习,有详细的操作方法和例程-Modelsim to use, suitable for beginners to learn, detailed operating methods and routines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:714.92kb
    • 提供者:夏思源
  1. elevator

    0下载:
  2. 用VHDL编写的一个电梯控制程序,花了很长时间,应该很不错的-VHDL prepared with a elevator control procedures, took a long time, should be very good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:714.8kb
    • 提供者:小毛
  1. DE2_115_TV

    0下载:
  2. 用FPGA开发板实现FPGA接受TV视频信号,然后显示在显示器上-FPGA development board FPGA accept TV video signal, and then displayed on the monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:714.63kb
    • 提供者:tony
  1. new_i2c

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  2. 用FPGA做的一个I2C接口程序......可以用于I2C通信-FPGA to do with a I2C interface program can be used for I2C communication .... ......
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:714.48kb
    • 提供者:王子辰
  1. S3Demo

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  2. Spartan 3 Digilent Demo:This demo drives the perphrials on the Spartan 3 board. This drives a simple pattern to the VGA port, connects the switches to the LEDs, buttons to each anode of the seven segment decoder. The seven segment decoder has a simpl
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:714.42kb
    • 提供者:Roy Hsu
  1. adder_4bits_jer

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  2. Verilog Adder4bits for education
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:714.33kb
    • 提供者:Joako
  1. DCtroller

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  2. FPGA分组式直流固态功率控制器的设计DC FPGA block design of solid-state power controller-DC FPGA block design of solid-state power controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:714.04kb
    • 提供者:han012
  1. VHDL_uart

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  2. 用xilinx的FPGA-spartan3E实现uart,固定波特率9600,偶校验,系统时钟50MHz,能够实现将从串口调试助手发送到FPGA的数据重新发回串口调试助手-using xilinx s FPGA-spartan3E to implement uart with a baudrate of 9600, even parity check. The system frequency is 50MHz.It can turn the data from serial assistant
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:714.03kb
    • 提供者:john
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