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  1. DE2_70_TV

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  2. 基于FPGA的视频转化的I2c配置芯片解码模块和解交织模块-FPGA-based video conversion reconciliation I2c configuration chip interleaving block decoding module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:696.6kb
    • 提供者:小锋
  1. Quartus

    0下载:
  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.24mb
    • 提供者:罗宾
  1. ram_dual

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  2. Design of a DRAM of any bit
  3. 所属分类:VHDL-FPGA-Verilog

  1. Xilinx_MicroBlaze

    0下载:
  2. 手把手学习xilinx的microblaze的使用方法,doc文档,希望对大家有帮助-Hands-on learning to use xilinx the microblaze, doc documents, we want to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:4.93kb
    • 提供者:veskel
  1. counter

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  2. 这是一个从零计数到9999在归零的vhdl程序,程序不复杂,对于理解分频原理,数码管显示原理有很大的帮助-This is a count from zero to zero in the vhdl program in 9999, the program is not complicated, the principle for understanding the frequency, digital display of great help to the principle
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.32kb
    • 提供者:王冰
  1. verilog_decimal_BCD

    0下载:
  2. 用verilog写的十进制转BCD码,希望对大家有帮助-Verilog to write with decimal switch BCD, we hope to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:56.41kb
    • 提供者:veskel
  1. gcd

    0下载:
  2. this a program to calculate the gcd of two numbers and then display the result-this is a program to calculate the gcd of two numbers and then display the result
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:172.23kb
    • 提供者:nauman
  1. AWG_CPLD_part

    0下载:
  2. 基于单片机(AT89S51)和CPLD(MAX7128)的任意波形发生器的设计——CPLD部分代码-Design of an AWG based on MCU(AT89S51) and CPLD(MAX7128)——CPLD part
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:451.27kb
    • 提供者:张振
  1. LineFollowCar

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  2. This show a line follow car.-This is show a line follow car.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:274.7kb
    • 提供者:Trung Kien
  1. FPGAdesign

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  2. FPGA设计全流程 pdf格式电子文档 fpgadesign-FPGA design of the whole process of electronic documents fpgadesign pdf format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:212.86kb
    • 提供者:陈征
  1. VerilogHDL

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  2. 数字系统设计与VerilogHDL 数字系统设计与VerilogHDL-Digital system design and digital system design and VerilogHDL VerilogHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-31
    • 文件大小:13.08mb
    • 提供者:陈征
  1. full_adder

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  2. 4 bit Full adder: addes two 4 bit numbers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:143.35kb
    • 提供者:Rishi
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