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  1. using_the_LUT_as_distributed_RAM_in_Spartan-3_FPGA

    0下载:
  2. 在 Spartan-3 系列 FPGA 中将查找表用作分布式 RAM-using_the_LUT_as_distributed_RAM_in_Spartan-3_FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7kb
    • 提供者:lishiwei
  1. multi8x8

    0下载:
  2. 通过元件例化语句和信号声明实现8*8的乘法器-Cases through the components of statements and declarations to achieve the signal multiplier 8* 8
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:64.65kb
    • 提供者:dongmei
  1. fulladder

    0下载:
  2. 由四位全加器通过元件例化语句设计成十六位的全加器-By four full adder component instantiated by statements designed 16 of the full adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:517.59kb
    • 提供者:dongmei
  1. sin_gene

    0下载:
  2. 读取mif方式,产生正弦信号的vhdl程序-Read mif way to generate sine signal vhdl program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:2.84kb
    • 提供者:张伯伦
  1. PLD_Programmable_Logic_Devices

    0下载:
  2. 可编程逻辑器件PLD Programmable Logic Devices不错的资料-Programmable logic devices PLDPLD Programmable Logic Devices good information
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1009.75kb
    • 提供者:c
  1. freqmeter

    0下载:
  2. Working Frequencymeter, some files are useless, you just have to look to total.vhd and see what s usefull or not!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:19.49kb
    • 提供者:VHDL_beginner
  1. 2222

    0下载:
  2. 12时钟数码管显示,芯片74161,151,248-12 clock digital display, chip 74161,151,248
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:53.29kb
    • 提供者:陶宝
  1. usb_cy7c68013_connect_to_PC_Source_Code

    1下载:
  2. usb_cy7c68013与PC通信源码-usb cy7c68013 connect toPC-- Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-09
    • 文件大小:56kb
    • 提供者:张好学
  1. C28xSoftwareTestBench(STB)Library

    0下载:
  2. This library contains the support modules for Software Test Bench (STB) framework.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:118.38kb
    • 提供者:zhouqijin
  1. Debussy_simulation_quick_guide

    0下载:
  2. Debussy仿真快速上手教程,2010 word修正版。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:271.34kb
    • 提供者:张超
  1. TAP4

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  2. JTAG TAP Statemachine verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:894byte
    • 提供者:张超
  1. TAP3

    0下载:
  2. JTAG TAP Statemachine verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:861byte
    • 提供者:张超
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