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  1. Verilog_VHDL

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  2. Verilog——解决初学者疑惑:VHDL、Verilog,System+verilog比较.pdf-Comparison of VHDL, Verilog and SystemVerilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:57.75kb
    • 提供者:S. Liu
  1. CPU

    0下载:
  2. verilog实现的一个简单的CPU,大家可下载去瞅瞅啊-verilog to achieve a simple CPU, you can download to Chou Chou ah
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-20
    • 文件大小:5.44mb
    • 提供者:zhangrongfei
  1. Barrel_shifter

    0下载:
  2. verilog语言的桶形移位器,实验课上做的,大家别见笑-Barrel shifter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.46mb
    • 提供者:zhangrongfei
  1. VerilogHDL

    0下载:
  2. Vhdl langerang is akiund tool of EDA-Vhdl langerang is akiund tool of EDA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:283.43kb
    • 提供者:ll
  1. vhdl

    0下载:
  2. 基于FPGA的I2C总线模拟,采用verilog HDL语言编写-I2C-bus FPGA-based simulation using verilog HDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:20.32kb
    • 提供者:kim
  1. singlecycleMIPS-lite

    0下载:
  2. mips processor——32bit-mips processor- 32bit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4.18kb
    • 提供者:李忠元
  1. processor

    0下载:
  2. verilog program for alu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:8.04kb
    • 提供者:saiprasanth
  1. topsequence

    0下载:
  2. modeling of fsm in vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:641byte
    • 提供者:MILIND
  1. clockbuffer

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  2. clock buffer for xilinx spartan 3e
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.16kb
    • 提供者:MILIND
  1. lcd

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  2. lcd display on xilinx spartan 3e
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.35kb
    • 提供者:MILIND
  1. PS2

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  2. CPLD 上实现 PS2键盘协议,可以读取PS2键盘,然后用串口发送,CPLD为Altera的EPM240-CPLD to achieve PS2 keyboard protocol, you can read the PS2 keyboard, serial port and then send, CPLD for Altera' s EPM240
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.26kb
    • 提供者:
  1. encoder8_3

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  2. 用VERILOG语言实现了常用8_3编码器.-Verilog language used to achieve a common decoder 3-8.-With the VERILOG language to implement common 8_3 encoder .- Verilog language used to achieve a common decoder 3-8.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:6.19kb
    • 提供者:彭红
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