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  1. buzzer

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  2. 一个简单的音乐发生器,说明如何通过FPGA产生声音-A simple music generator, how to have a voice through the FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.55mb
    • 提供者:chengliu
  1. rs232

    0下载:
  2. 通过FPGA实现串口通信,结果在超级终端可见-Serial communication through the FPGA, the result can be seen in the HyperTerminal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:625.79kb
    • 提供者:chengliu
  1. 8086

    0下载:
  2. 基于FPGA的8086/8088 IP核-8086/8088 FPGA IP Core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.32mb
    • 提供者:chengliu
  1. FPGA_Program

    0下载:
  2. 用VHDL语言编写的实用例子程序,希望能对各位有所帮助。-VHDL language with practical examples of the procedure, hoping to be helpful to you.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.26mb
    • 提供者:guangfany
  1. fpga_tcl

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  2. Altera FPGA的特殊管脚的连接(中文).doc TCL_教程.pdf-Altera FPGA tcl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:614.87kb
    • 提供者:朱柏
  1. cic_fpga

    0下载:
  2. CIC抽取滤波器的改进及其FPGA的实现.pdf-cic _fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:163.09kb
    • 提供者:朱柏
  1. BKMP3_verilog

    0下载:
  2. The mp3 decoder write by using Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-11-12
    • 文件大小:2.05mb
    • 提供者:hqgoldswan
  1. VerilogHDL

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  2. 一本不错的verilog入门学习资料,方便初学者学习及使用。-A good entry-learning verilog information for beginners to learn and use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.62mb
    • 提供者:尹力超
  1. ADD

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  2. ADD instruction for the HC08 Target
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.23kb
    • 提供者:saffey
  1. ADC

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  2. ADC instruction for HC08 Target
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.27kb
    • 提供者:saffey
  1. shuma0-3

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  2. 利用verilog语言编程 以FPGA为开发工具实现数码管0-3显示!-Verilog language programming to the use of FPGA development tools for the realization of digital tube 0-3 show!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:196.92kb
    • 提供者:李兆涛
  1. traffic

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  2. verilog编写的一个交通灯程序,利用状态机实现。压缩包内有说明文档,源代码及时序截图-verilog prepared a program of traffic lights, the use of state machine to achieve. Compressed packet, there are documentation, source code and timing Screenshots
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:485.89kb
    • 提供者:尹力超
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