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  1. adc16

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  2. 此例程是针对FPGA的16位模拟数字转换器的程序,相信这对需要进行模数转换的朋友辉用到的-This routine is for the FPGA of 16-bit analog-to-digital converter program, I believe this is the need for analog-to-digital converters used in a friend-hui
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.09kb
    • 提供者:徐礼静
  1. UniversalRegister

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  2. 这种设计是一个普遍的登记册可作为一个简单的存储登记,双向移位寄存器,计数器的行动和反跌。登记册可以载入了一套并行数据输入和模式是由3位输入。-This design is a universal register which can be used as a straightforward storage register, a bi-directional shift register, an up counter and a down counter. The register can be
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:748byte
    • 提供者:徐礼静
  1. measure

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  2. 用VHDL语言编写一个状态机电路,可实现对脉宽的测量-VHDL language with a state of electrical and mechanical way, enabling the measurement of the pulse width
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:334.62kb
    • 提供者:胡一
  1. adcontro

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  2. 此程序为FPGA对adc0809的控制以及数据采集程序,谢谢大家指教- This procedure for the FPGA on the adc0809 control and data acquisition procedures, Thank you for your advice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:906byte
    • 提供者:徐礼静
  1. lcd12864_1

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  2. lcd12864的显示汉字程序源代码,共四行,每行8个汉字。-Chinese lcd12864 display source code, a total of four lines, eight characters per line.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.36kb
    • 提供者:刘峰
  1. NiosII

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  2. 一个NIOS II初学者非常好的资料,提供了大量的实例。-FPGA NIOSII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.8mb
    • 提供者:roal
  1. test_in

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  2. 用Verilog编写的产生图像的程序,实现24位数据量产生图像使用DA转换后直接显示-Verilog prepared using the procedure for selecting the images to achieve 24-bit image data generated using the DA converter and directly show the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:856byte
    • 提供者:lvxingli
  1. Verilog

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  2. 夏宇闻-Verilog经典教程,对想要学习Verilog的人提供帮助-Xia Wen-Verilog Classic Guide for those who want to learn Verilog help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.26mb
    • 提供者:hao
  1. choosebcd

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  2. 48位BCD码自动识别,并判断是否有无用位,并输出到下一段输出-48 BCD code automatic identification and to determine whether any use of digital and output to the next section of the output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:644byte
    • 提供者:hao
  1. Binary_to_BCD_Converter

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  2. General Binary-to-BCD Converter The linked code is a general binary-to-BCD Verilog module, and I have personally tested the code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:25.16kb
    • 提供者:volkan
  1. xilinx0424

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  2. Xilinx中文官方培训材料(全),Xilinx新手用户必备材料。-Xilinx Chinese official training materials (all), Xilinx novice users required materials.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.55mb
    • 提供者:李竞松
  1. vhdl-MIPS

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  2. Quartus-Altera Nios... VHDl based, complete MIPS implementation, document, flowcharts plus code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:4.13mb
    • 提供者:ak
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