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  1. analogue-digi-ana-converter

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  2. design and implementation of a format conversion system on the Altera NIOS board(QUARTUS) which reads an analogue input, converts it into digital data, and then does the reverse conversion back into analogue format. This will be done by taking an ana
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.33mb
    • 提供者:ak
  1. report-hex-keypad-debouncer

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  2. Quartus Verilog HDL, complete document, having schematics, flowcharts, and Verilog codes for various modules for implementing a hex-keypad, including the important code of DEBOUNCER
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:779kb
    • 提供者:ak
  1. LCD

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  2. FPGAC串口数据接收 lcd液晶显示程序-FPGA lcd
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.97mb
    • 提供者:lishuang
  1. modelsim

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  2. 学习modelsim 脚本仿真的绝佳范例 学习modelsim 脚本仿真的绝佳范例-modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:145.83kb
    • 提供者:项勇
  1. UniversaRlegister

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  2. 通用寄存器的编程,能对FPGA的学习有更进一步的了解,尤其对初学者帮助多多。-General Register of programming, the FPGA can have a better understanding of learning, especially for beginners to help a lot.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:691byte
    • 提供者:zhenghonglei
  1. TONGBUTIQU

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  2. FPGA实现信号的同步提取功能,通信原理实验.-FPGA realization of the synchronization signal extraction functions, communications experiment.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:182.41kb
    • 提供者:赖云鹏
  1. fifo

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  2. 格雷码对地址编码的异步FIFO的实现方法-Gray code encoding to address the realization of the asynchronous FIFO method
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1014byte
    • 提供者:hj
  1. cic_bf

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  2. vhdl编写的梳妆滤波器和蝶形运算的算法。蝶形计算通过调用fpga内部的乘法器实现。-dressing prepared vhdl butterfly filters and computing algorithms. Butterfly calculation by calling the multiplier to achieve within the fpga.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.02kb
    • 提供者:lmy
  1. filter_vhdl

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  2. vhdl语言编写的fir和iir滤波器程序。在quartus上仿真通过。-vhdl language program fir and iir filters. Quartus adopted in the simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:36.84kb
    • 提供者:lmy
  1. cordic

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  2. vhdl语言编写的cordic算法,实现了cordic的流水线运算。-cordic language vhdl algorithm cordic the pipeline operator.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:813byte
    • 提供者:lmy
  1. SDRAM_CTR

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  2. vhdl语言编写的fpga控制sdram的程序,包括仿真结果.-program of vhdl to control sdram in which includes the simulating results
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:315.53kb
    • 提供者:lmy
  1. verilog

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  2. verilog代码,对学习有很大帮助-verilog code of great help in learning. . . . . . . . . . . . . .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:183.18kb
    • 提供者:bruce
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