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  1. TrafficLight

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  2. 用vhdl写的交通灯程序,压缩包内有整个工程文件-With the traffic lights to write vhdl procedure, compressed package files have the whole project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:191.2kb
    • 提供者:lyb1900
  1. DE2_TV

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  2. it s so easy and important
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.66mb
    • 提供者:fizah
  1. Pulse_Width_Modulator_Altera_MAX_II_CPLD_Design_E

    0下载:
  2. Example VHDL project showing how to use a PWM by CPLD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:283.99kb
    • 提供者:maros
  1. I2c_EEPROM

    0下载:
  2. I2C VHDL simulation, creates i2c with vhdl for simulation purposes. use it at your own risk.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.93kb
    • 提供者:alex
  1. Test_LED[1]

    0下载:
  2. 用VHDL实现的一个工程,可以参考来学习FPGA的设计-VHDL achieved with a project, you can reference to learn the design of FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3.41mb
    • 提供者:卫立波
  1. all_packages_20080525.tar

    0下载:
  2. FMF VHDL Models All the FMF models are VHDL 93 and VITAL 2000 compliant and require the VITAL 2000 library for correct compilation. They are designed for timing backannotation by means of an SDF file. The intrinsic delays default to 1 ns. We hav
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:20.35kb
    • 提供者:ledo
  1. Subroutine

    0下载:
  2. VHDL常用的22个子程序,适合入门的学习-22 sub-VHDL procedures commonly used for the learning portal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:23.48kb
    • 提供者:王张刚
  1. ZHEJIANG_VHDL

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  2. 浙江大学的VHDL讲义,内容翔实丰富,对想掌握这门语言的同学用处极大,我觉得不错,与大家一同分享。-Materials, Zhejiang University of VHDL, rich informative, and would like to master the language the students use great, I feel good to share with you.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:373.95kb
    • 提供者:王强
  1. VHDL

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  2. VHDL语法入门 1.1 VHDL程序构件 1.2 文法规则 1.3 数据对象及类型 1.4 运算符与表达式 1.5 VHDL语句 1.6 进程与子程序 1.7 资源库与程序包-Introduction to VHDL syntax 1.2 Component 1.1 VHDL procedures grammar rules and type of data object 1.3 Operators 1.4 and 1.6 Expression 1.5 VHDL p
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:21.08kb
    • 提供者:王强
  1. Verilog_phone_countpay

    0下载:
  2. VerilogHDL编写的一个电话计费程序 具有一定的代表性-VerilogHDL prepared a telephone billing procedures for a certain degree of representativeness
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.18kb
    • 提供者:YangPeng
  1. Verilog_Music_liangzhu

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  2. Verilog实现的一首好听的音乐 梁祝,希望对大家有帮助-Verilog realization of a good music Butterfly, I hope all of you help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1.03kb
    • 提供者:YangPeng
  1. Verilog_Traffic_light_controller

    0下载:
  2. Verilog实现的交通灯控制的程序 运行通过无语法错误-Verilog realization of the control of traffic lights run through the non-syntax error
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:984byte
    • 提供者:YangPeng
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