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  1. how_to_use_Libero8

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  2. 是libero的使用说明,如果想使用actelfpga的libero软件可以试试它。-the reference of actel fpga soft Libero8.5, and it s good tool for new learner.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.5mb
    • 提供者:书荣
  1. Ethernet

    0下载:
  2. xilinx xupv5-110t ethernet mac调试,工程已做好,直接可用。-xilinx xupv5-110t ethernet mac
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3.94mb
    • 提供者:杨勇
  1. aurora_8b10b_v5_2

    0下载:
  2. xilinx xupv5-110t sma口(aurora)调试 ,LVDS-xilinx xupv5-110t aurora
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.08mb
    • 提供者:杨勇
  1. Archive

    0下载:
  2. i enclosed the win socket
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:5.4kb
    • 提供者:anuprasanth
  1. Port-RAMs

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  2. 介绍双口ram功能,进一步了解在fpga上怎么设计一个双口ram-Introduced the dual-port ram function to learn more about the fpga on how to design a dual port ram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:344.49kb
    • 提供者:吴越强
  1. FIFO_exp

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  2. 一个关于如何使用 xilinx FIFO 的经验,非常值得借鉴-a PFF report about how to use FIFO core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:504.57kb
    • 提供者:liaolain
  1. hanmingcode

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  2. 包含汉明码的编码和解码的程序和测试程序,连接程序和连接测试程序。在modelsim仿真通过。-include hanmingencode and hanminglecode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:4.19kb
    • 提供者:王可
  1. count8

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  2. 数码管动态循环显示0-9-Dynamic digital tube display cycle 0-9
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:172.22kb
    • 提供者:范珊珊
  1. ALTERA-CPLD

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  2. ALTERA CPLD实验系统用户手册,为初学者提供硬件开发系统介绍学习-ALTERA CPLD experiment system user manual For beginners to provide hardware development system study
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:108.16kb
    • 提供者:范珊珊
  1. quartus2

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  2. quartus 2 软件学习资料,为处学者提供详细的软件操作及其编程语言介绍-Quartus 2 software, learning materials, for scholars Department provide details of the software and its programming language introduced
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:1.97mb
    • 提供者:范珊珊
  1. dada

    0下载:
  2. ad数据采集 一路的AD数据采集 使用状态机控制AD时序-data collection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:2.13kb
    • 提供者:谢景磊
  1. buzzer

    0下载:
  2. verilog 写的V5板子上的蜂鸣器测试代码 可以直接使用 测试过-this is a code applied for buzzer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:824byte
    • 提供者:谢景磊
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