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  1. num09211870

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  2. 北邮大学VHDL课程的结课题代码,一种基于fpga或者cpld实现的拔河机器代码-BUPT Results of VHDL course subject code, based on fpga or cpld tug of war machine code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1002.79kb
    • 提供者:吴琨
  1. Elevator-automatic-control-program

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  2. 电梯自动控制程序Elevator automatic control programElevator autoElevator automatic control programmatic control program-Elevator automatic control program Elevator automatic Elevator automatic control programcontrol program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:371.1kb
    • 提供者:chen xiang
  1. DDS

    0下载:
  2. dds数字频率合成器,可用来产生不同频率的正弦波形用作正弦信号发生器-dds Can be used to generate the sine wave of different frequencies
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.09mb
    • 提供者:焦艳华
  1. mux21gr

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  2. 毛刺信号被消除的2选1多路复用器,a,b是输入,s是选择信号,y是输出。-Burr signal is eliminated 2 to 1 Multiplexer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:4.91kb
    • 提供者:709409701
  1. buffer

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  2. 一个串行接收,并行发送的缓存器,其数据存储使用双端口SRAM(一读一写)实现,SRAM大小为深64、宽32位(64字×32位,使用提供的双端口SRAM见目录rf2shd4)。缓存器按一位串行输入接收数据,缓存器位置全满后不再接收串行数据输入;并根据读数请求,按接收数据的顺序,将接收完整的32位数据发送出去,并标记该缓存器位置为空,又可以放置新的串行输入数据。 设计了同步和异步两种串行发送方法。-Receive a serial, parallel send buffer, the data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:408.33kb
    • 提供者:张见
  1. THDB_ADA_v.1.4.2_SystemCD

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  2. THDB_ADA光盘资料,包含全部资料,全部例程。-THDB_ADA CD-ROM contains all the information, all the routines.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.69mb
    • 提供者:hxy
  1. pid_VHDL

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  2. PID程序VHDL编写,很好的。调试成功通过。-The source code of PID in VHDL.it is usefull .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:349.92kb
    • 提供者:Alen Fielding
  1. Fuzzy_PID

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  2. 用VHDL语言编写的模糊PID程序代码。成功调试,运行良好。-The source code of Fuzzy_pid in VHDL.Simulation was successful.
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-17
    • 文件大小:2.01kb
    • 提供者:Alen Fielding
  1. Crack_QII72_FULL_License.RAR

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  2. Quartus II 7.2最完美的license破解器!-Quartus II 7.2 FULL and perfect License!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:340kb
    • 提供者:hxy
  1. jiaotongdeng

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  2. 显示模块包括数码管动态扫描电路和译码显示电路,动态扫描电路用于选择需要显示的数码管,译码显示电路用于将输入的二进制信息转换为数码管显示编码。显示模块中使用四个数码管显示倒计数值,两个用于显示东西方向倒计时值,两个用于显示南北方向倒计时值,使用四组红、黄、绿发光二极管显示通行、进行和转弯。由于没有转弯控制信号灯,所以使用红灯、绿灯亮黄灯闪烁作为转弯的指示信号。-The display module includes a dynamic scanning circuit and decoding o
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:662byte
    • 提供者:常东东
  1. CUBLAS_Library_2.1

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  2. cuda 很好的教程 希望对大家有帮助 -the cuda good tutorial We hope to help you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:666.17kb
    • 提供者:张志鹏
  1. teach

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  2. 一个简单的nios系统,让初学者更容易理解nios-A simple nios system, so beginners are easier to understand nios
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-03
    • 文件大小:14.52mb
    • 提供者:李达
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