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  1. qam

    0下载:
  2. This is a simple QAM modulator demodulator with testbench included.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:44.34kb
    • 提供者:maperna
  1. cic_core

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  2. cic积分梳状滤波器的verilog代码-the cic integral comb filter verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:87.4kb
    • 提供者:李雪利
  1. rs232_interface

    0下载:
  2. RS232串行接口verilog代码和测试-Verilog code and testing of the RS232 serial interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:38.73kb
    • 提供者:李雪利
  1. ethernet_tri_mode

    0下载:
  2. 三速以太网接口模块verilog源码和测试-Triple-speed Ethernet interface module verilog source code and test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.95mb
    • 提供者:李雪利
  1. fir_filter_generator

    0下载:
  2. FIR有限冲击响应滤波器verilog代码和测试-FIR finite FIR filter verilog code and test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.76mb
    • 提供者:李雪利
  1. viterbi_decoder_axi4s

    0下载:
  2. Viterbi译码器的verilog代码和测试-Verilog code and testing of the Viterbi decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:18.05mb
    • 提供者:李雪利
  1. spi_slave

    0下载:
  2. SPI的verilog源代码,可以和DSP2812通信,已经试过,可行。-SPI verilog source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:673byte
    • 提供者:达达
  1. adder

    0下载:
  2. This the program for addition in verilog-This is the program for addition in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:300.55kb
    • 提供者:chella
  1. Q

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  2. 高级FPGA 教学实验平台实验指导书-逻辑设计-Advanced FPGA teaching experimental platform for experimental instructions- logic design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.04mb
    • 提供者:boseylee
  1. module-ad

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  2. AD控制程序,基于Verilog语言来编写程序代码.-AD control program based on the Verilog language to write code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4.37kb
    • 提供者:erick
  1. debug

    0下载:
  2. 基于LEON3的片上网络调试系统和相关的技术资料-The LEON3 the network on chip debug system and related technical information
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:938byte
    • 提供者:胡永春
  1. div

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  2. 一分频,通过计数器原理得到的一分频。十分简洁,适合初学者-A divide, a divide counter principle. Very simple, suitable for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:717byte
    • 提供者:郭稳
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