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  1. lcd

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  2. 实现ICD显示,在ISE8.2运行,芯片为xinlix的virtex4-To achieve ICD display, run in ISE8.2 chip xinlix the virtex4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:767.38kb
    • 提供者:冯丽洋
  1. serial_adda

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  2. 实现串口,在ISE8.2运行,芯片为xinlix的virtex4-To achieve serial port, ISE8.2 running chip for xinlix the virtex4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:788.53kb
    • 提供者:冯丽洋
  1. parall_ad_da

    0下载:
  2. 实现ad_da,在ISE8.2运行,芯片为xinlix的virtex4-Achieve ad_da, running in ISE8.2 chip for xinlix the virtex4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:882.91kb
    • 提供者:冯丽洋
  1. trajectory_planning_2011_11_09

    0下载:
  2. 运用FPGA,创建NIOS2处理器,进行机器人逆运动学的轨迹规划,采用的是ALTERA 的飓风2处理器,处理速度非常快-The use of the FPGA, create NIOS2 processor, inverse kinematics, trajectory planning, the the ALTERA hurricane 2 processor, the processing speed is very fast
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:5.34mb
    • 提供者:沙佑平
  1. ad9850

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  2. 介绍了用FPGA控制DDS产生任意频率范围之内的可调制正弦波,13位BPSK,ASK等。控制字由串口写入。-verilog control AD9850 to get psk ask
  3. 所属分类:VHDL编程

    • 发布日期:2013-11-08
    • 文件大小:1.35mb
    • 提供者:chen
  1. filter

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  2. 巴特沃斯滤波器的Verilog实现,基于matlab-Butterworth filter Verilog implementation based on matlab
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:6.28kb
    • 提供者:sun
  1. shuziclk

    0下载:
  2. 数据时钟vhdl的设计小时分钟秒 具有复位 闹钟 和整点报时等功能。-Vhdl design data clock hours minutes seconds reset the alarm and hourly chime function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:1.56mb
    • 提供者:monkey
  1. MonitorB

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  2. 用VHDL写的一个信息监视系统,包括对信息的整形、串并转换和奇偶校验等 还有状态的判断,信息格式的判断等 一个监视器-VHDL write a monitoring system, including the shaping of information, serial-to-parallel conversion and parity status judgment, the judgment of the information format monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:775.6kb
    • 提供者:xiaok
  1. traffic_led

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  2. 基于FPGA芯片设计多功能交通灯,该模块利用状态机设计,能实现交通指示功能-FPGA-based chip design multi-functional traffic lights, the module state machine design, traffic directions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:454.07kb
    • 提供者:
  1. sm

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  2. 基于xc4vsx25芯片而开发的verilog语言程序,实现按键输入数字密码并显示于数码管上的功能。程序均已通过调试试验,可于SEED-XDTK_V4实验箱上实现。-Verilog language program developed based xc4vsx25 chip key input digital password displayed on the digital tube on the function. Procedures are debugging test in SEED-
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:4.42kb
    • 提供者:徐世超
  1. i2c

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  2. 用verilog写的I2C源码,对于学习硬件语言和处理器及总线相关知识有很大帮助。-I2C source code, written with verilog language and learning hardware processor and bus-related knowledge.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:359.21kb
    • 提供者:shen jun
  1. bell

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  2. 利用VHDL语言进行嵌入式设计(FPGA),蜂鸣器程序,生成蜂鸣器模块-Using VHDL language Embedded Design (FPGAs) buzzer program to generate buzzer module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:291.94kb
    • 提供者:叶子
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