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  1. DE2_pin

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  2. DE2控制面板 液晶显示验证代码 用verilog 语言描写的-this is a control panel about LCD s display expierents
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:2.71kb
    • 提供者:yuanying
  1. arm7_6500_keil_print_emi

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  2. ARM7内核,EMI模块测试程序,用于FPGA测试,内含print功能-ARM7 core, the EMI module testing procedures for FPGA test, containing the print function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:391.38kb
    • 提供者:孙文
  1. arm7_6500_keil_print_wdg

    0下载:
  2. ARM7环境下watchdog模块测试程序,自带print功能-ARM7 environment watchdog module test procedures, its own print function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:390.73kb
    • 提供者:孙文
  1. kb_monitor

    0下载:
  2. 用rs-232 cable 將ps/2鍵盤資訊傳送到pc-look up kb scan code in pc through rs-232 cable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:296.24kb
    • 提供者:wimiu
  1. clock-divider

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  2. clock generator vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:570byte
    • 提供者:sgma
  1. Rs232-reciever

    0下载:
  2. RS232 reciver vhdl code for RS232 EIA232-RS232 reciver vhdl code for RS232 EIA232
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:2.06kb
    • 提供者:sgma
  1. ads1282_code

    0下载:
  2. 用VHDL写的控制TI公司32位高精度ADC的程序,可以可靠运行,已经应用于实际项目-Control TI' s 32-bit precision ADC program written using VHDL, reliable operation, has been applied to the actual project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:468.42kb
    • 提供者:陈耀弘
  1. counter

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  2. 基于FPGA的计数器程序涉及,可以自由移植使用-Transplantation using FPGA-based counter program involves freedom
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:2.96kb
    • 提供者:jiangke
  1. dds_quicklogic-FPGA

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  2. dds_quicklogic FPGA DDS信号源-dds_quicklogic FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:66.28kb
    • 提供者:zhaochao
  1. lcd1602

    0下载:
  2. LCD1602液晶显示应用在FPGA显示-The LCD1602 LCD applications in FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:3.66kb
    • 提供者:wenyangzeng
  1. game_timing

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  2. 比赛计时 棋类比赛 包括篮球 羽毛球 乒乓球 -time couting
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:34.64kb
    • 提供者:liuxinzhao
  1. TimingTheWorld_Decimal

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  2. 计时,最短时间为100Hz,BASYS2 board,FPGA 可以在7-Segment上显示时间。-Timing the world
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:280.97kb
    • 提供者:Mao Yimeng
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