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  1. PS2VHDL

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  2. 用VHDL语言编写的用PS2键盘程序,用数码管来显示键盘的asii值已经调试验证过了。-Using VHDL language with a PS2 keyboard program, with digital control to display the keyboard asii values have Debugging verified.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:477.9kb
    • 提供者:曾小曾
  1. DFlipFlop

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  2. 实现双D触发器,已经通过验证,可以实现一般的功能,放心使用-Dual D flip-flop
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:369.66kb
    • 提供者:陈敏华
  1. comuputer-embroidery-machine-design

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  2. 本文章是基于ARM和FPGA的电脑刺绣机设计,希望对从事电脑刺绣机行业的编程开发人员有所帮助-This is a article about the design of computer embriodery machine based on the ARM and FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:3.72kb
    • 提供者:胡康康
  1. ddsplus

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  2. 正弦波信号发生器,同时输出同频率锯齿波作为外触发扫描信号-Sine wave signal generator, while the output of the same frequency sawtooth sweep signal as an external trigger
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.3mb
    • 提供者:朱志超
  1. sbq

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  2. 基于fpga和传统示波器工作方式的vhdl程序,通过ad0809采样信号(可兼容tlc5510)再经由8位da转换输出,同时输出外触发锯齿波,建议使用感性小的示波器探头,否则锯齿波低频时会出现失真-Fpga-based and traditional ways of working oscilloscope vhdl procedures, through ad0809 sampling signal (compatible tlc5510) and then through eight da
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-05-18
    • 文件大小:5.95mb
    • 提供者:朱志超
  1. pc104vhdl_change

    0下载:
  2. PC104总线的CPLD代码,调试已经通过,可以修改应用到其他的工程-PC104 bus CPLD code, debugging has been passed, you can modify the application to other engineering 示例用法:
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:49.72kb
    • 提供者:张又文
  1. text5

    0下载:
  2. 循环彩灯,实现彩灯的花色点亮,利用状态机实现各种花色的实现-Cycle lights, to achieve the suit lit lanterns, using the state machine to achieve the realization of various colors
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:906.42kb
    • 提供者:
  1. love

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  2. FPGA的综合应用,利用状态机和LCD实现LED灯的花色变换的同时,在液晶显示屏上同时显示“I LOVE YOU”字样!-FPGA integrated application, the use of state machines and color LCD with LED lights transform while simultaneously displayed on the LCD screen " I LOVE YOU" words!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.2mb
    • 提供者:
  1. cycle_measure

    0下载:
  2. 测量周期,此程序已经在EP2C板子上成功实现-mesure cycle
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:155.7kb
    • 提供者:zhai qing wei
  1. dds_simu_v100

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  2. 占空比,幅值,步进可调的DDS模块,已经在板子上成功实现-Duty cycle, amplitude, step adjustable DDS module, the board has successfully achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:378.05kb
    • 提供者:zhai qing wei
  1. HDL-player

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  2. HDL Player for Xilinx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6.95kb
    • 提供者:Tsai_Jimmy
  1. add

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  2. VHDL 相应加法器的测试向量(test bench),非常简单的。我已测试通过-VHDL equal 8-bit comparator routines, very simple. I have the test pass
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.39kb
    • 提供者:wangjianming
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