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  1. datapath

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  2. 单片机PIC16C5X的datapath代码,包括ALU,alu_mux,w_reg和各个指令的代码-The datapath PIC16C5X microcontroller code, including ALU, alu_mux, w_reg and each instruction code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.11kb
    • 提供者:泉哥哥
  1. MRAM2012

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  2. STT-MRAM磁性存储器全部verilog代码和仿真验证代码,包括行为模块,读写模块和控制模块,已经经过验证完全正确-STT-MRAM magnetic memory all the code and simulation code, including behavior module, reader module and the control module, has been proven entirely correct
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.32kb
    • 提供者:泉哥哥
  1. barrelshifter

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  2. barrel shifter of 32bit using mux2by1.It is implemented in 5stages of mux.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:818.25kb
    • 提供者:srikanth
  1. black_jack

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  2. verilog编写的21点游戏,用状态机写的,A可以表示1也可以表示11.-verilog 21-point game, written by a state machine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:621byte
    • 提供者:homeaway
  1. circuit_timing

    0下载:
  2. verilog延时电路的不同写法,和综合能否。可对比学习-Different wording verilog delay circuit, and comprehensive ability. Comparable learning
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:520byte
    • 提供者:homeaway
  1. TLB

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  2. 用verilog语言实现了快速线性列表的查找,程序实现了一个基本框架,下载下来可以添加新内容-Using verilog language to achieve a fast linear list to find the program implements a basic framework, you can add new content downloaded
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7.24kb
    • 提供者:蒋帅
  1. Adder_Array

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  2. 用verilog 实现了一个加法器阵列的计算,32位,位数可以扩展。-Verilog achieved by calculating an adder array 32, the median can be extended.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:654byte
    • 提供者:蒋帅
  1. Elevator_controller

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  2. Digital clock using Quartus9.1 platform, using Verilog language, to share to everyone
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.74mb
    • 提供者:huyunchuan
  1. new_uart

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  2. 串口的调试程序,可用串口调试助手对串口进行收发数据的检测-Debugger serial, serial debugging assistant available to detect the serial data transceiver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.82mb
    • 提供者:ljp
  1. Verilog_digital_clock

    0下载:
  2. Digital clock using Quartus9.1 platform, using Verilog language, to share to everyone
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.92mb
    • 提供者:huyunchuan
  1. AM

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  2. 实验利用matlab 软件实现直接数字频率合成-Experiments using matlab software direct digital frequency synthesis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.03mb
    • 提供者:陈杨
  1. adc12d1000_rfrb

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  2. ADC12D800 source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.87kb
    • 提供者:denkins2020
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