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  1. LedWater

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  2. 使用Xilinx公司的XC95288XL芯片来实现16只LED流水灯控制-XC95288XL using Xilinx s chip to achieve 16 LED light water control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.61mb
    • 提供者:窦海霞
  1. half_sub

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  2. 用Verilog语言实现的半加器功能,非常好的例程。-Verilog language implementation with half adder function, very good routine.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:228.32kb
    • 提供者:毛超
  1. ModelSim_GUI_Introduction

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  2. Quartus tutorial on Model Simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.17mb
    • 提供者:Ajiya Abbas
  1. LEON3_GRLIB_Source_grlib-gpl-1.3.7-b4144.tar-(1).

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  2. Leon3 Ultra Sparc Compatible Processor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.93mb
    • 提供者:Andy
  1. The-encoder-and-decoder-for-ASK

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  2. 青创电子的ASK-编码器和译码器程序代码,实现编码和译码功能-Green and electronic ASK- encoder and decoder program code, realize the encoding and decoding function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:246.5kb
    • 提供者:JIM
  1. The-encoder-and-decoder-for-ASK-CMI

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  2. 青创电子的CMI-编码器和译码器程序代码,实现编码和译码功能-Green and electronic CMI- encoder and decoder program code, realize the encoding and decoding function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:188.27kb
    • 提供者:JIM
  1. FFT

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  2. 青创电子的驱动FFT显示屏的VHDL程序代码,-Green and electronic drive FFT display screen of VHDL program code,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.82kb
    • 提供者:JIM
  1. FPGA_traffic

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  2. 用VHDL写的交通灯程序,非常有参考价值,写的很好,值得一看。-Write VHDL traffic lights program, a very valuable reference, write well, worth a visit.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:111.23kb
    • 提供者:毛超
  1. FPGA_Seg7_dsp

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  2. 关于VHDL和verilog的数码管显示程序,写的很好,值得参考。-About VHDL and verilog digital tube display program, write well, worth considering.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:312.96kb
    • 提供者:毛超
  1. FPGA_dots

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  2. 关于VHDL和verilog的点阵显示程序,很好的例程,值得参考。-Dot-matrix display on VHDL and verilog program, a very good routine, a good reference.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:98.68kb
    • 提供者:毛超
  1. MySopc

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  2. 自己亲自设计的软核,可以打开详细的设计细节,仅作为参考,自己用的话要根据自己的情况进行设计。-Soft-core own personally designed, you can open the detailed design details, only as a reference, they used words to be designed according to their own situation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-29
    • 文件大小:10.85mb
    • 提供者:毛超
  1. guibing

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  2. 该设计采用VHDL语言将五个数的从大到小排序,采用的方法是归并插入排序算法。该算法能在最少比较次数(七次)情况下排列出五个数的大小顺序。-This design using VHDL language will be ordered five digits from big to small, the method is to merge insertion sort algorithm. The proposed algorithm can at least compare (seven) i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.47mb
    • 提供者:田慧中
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