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  1. tlv5638_ise12migration

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  2. 使用SPI通信协议,quartusII开发环境,编写5638驱动-Using SPI communication protocol, quartusII development environment, the preparation of 5638 drivers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:483.49kb
    • 提供者:金英
  1. tb_contrast_stretch

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  2. contrast strech for image pixles
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1015byte
    • 提供者:Adnan
  1. log_generator

    0下载:
  2. log10 generator in vhdl. simulated in Modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.57kb
    • 提供者:Adnan
  1. wdog_sp805

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  2. 看门狗模块是一个AMBA从属模块连接到高级 外设总线(APB)。看门狗模块包括一个32位的递减计数器用 可编程超时间隔具有产生中断和能力 对超时复位信号。它的目的是要使用到复位应用于在一个系统 事件的软件故障。-The Watchdog module is an AMBA slave module and connects to the Advanced Peripheral Bus (APB). The Watchdog module consists of a 32-b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:208.46kb
    • 提供者:st
  1. calculator

    0下载:
  2. 能够实现8位的无符号数的乘除法,模拟了笔算的过程-Unsigned 8-bit multiplication and division can be achieved, simulation the written calculation process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.12mb
    • 提供者:yujie
  1. lcd_system

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  2. lcd系统:包含了图片显示、汉字字库、PS2输出的lcd显示系统。-lcd system: Contains pictures show, Chinese character, lcd PS2 output display system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.13mb
    • 提供者:刘佳益
  1. FIFO

    0下载:
  2. FIFO先进先出,控制时序,对urat、SDRAM、DAC等时序理解都有帮助-FIFO FIFO control the timing of urat, SDRAM, DAC and other timing understanding have helped
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.27mb
    • 提供者:刘佳益
  1. VHDL_Examples_DE1_SoC

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  2. DE1-COS学习例程,用VHDL语言为FPGA写入按键显示程序,有助于学习-DE1- COS learning routines, for FPGA with VHDL language display program written to buttons, helps to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.85mb
    • 提供者:刘国松
  1. FIFO_Memory

    0下载:
  2. FPGA memory implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.48mb
    • 提供者:Sandeep
  1. x7seg

    0下载:
  2. 一个实用的FPGA数码管显示驱动,移植性比较好,Verilog语言编写,实测通过,可直接作为子模块调用-A practical FPGA digital display driver, portability is better, Verilog language, measured by, as a sub-module can directly call
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.12mb
    • 提供者:郭永峰
  1. pong

    0下载:
  2. Simple pong VGA game implemented in VHDL. It can be used as example for FPGA-programmers to show how handle VGA displaying with FGPA device.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.33mb
    • 提供者:John
  1. BCD_2EX

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  2. BCD-Excess3 transcoder described in VHDL language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:759.83kb
    • 提供者:John
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