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  1. Audio_In_Deserializer

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.21kb
    • 提供者:gasha
  1. Audio_Out_Serializer

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.19kb
    • 提供者:gasha
  1. cmd_pro

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  2. 用于SD卡通信控制部分的命令收发部分,verilog语言描述-Communications control part for the SD card send and receive part of the command, verilog language to describe the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:7.44kb
    • 提供者:朱红梅
  1. Avalon_Audio

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.85kb
    • 提供者:gasha
  1. Clock_Edge

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:614byte
    • 提供者:gasha
  1. SYNC_FIFO

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:870byte
    • 提供者:gasha
  1. data_pro

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  2. 用于SD卡通信控制部分的数据收发部分,verilog语言描述-SD cards for some of the data send and receive communication control part, verilog language to describe the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:8.78kb
    • 提供者:朱红梅
  1. yunlei

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  2. 实现出租车计费系统,包含所有的源文件-Taxi billing system to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:732.03kb
    • 提供者:lilei
  1. i2c_master

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  2. I2C控制器,应用于各种I2C主从设备间的通讯-I2C controller, applied to a variety of I2C communication between master and slave devices
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:4.98kb
    • 提供者:朱红梅
  1. ks_tree

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  2. 树形加法器 非常实用 进过测试可以达到很高的频率 可直接应用于乘法器电路-ks_tree
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:4.35mb
    • 提供者:李文民
  1. Quartus

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  2. 用vhdl编写的信号发生器源程序,可以产生正弦波,也可以根据需要产生其他波形-Prepared using vhdl source signal generator can produce sine wave, you can also produce other waveforms as needed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:367.1kb
    • 提供者:LFwen
  1. CU

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  2. mips指令控制器。fpga上板验证实现。为cpu课设重要模块-mips instruction controller.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:5.65kb
    • 提供者:dukenunee
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