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  1. VHDL-VGA

    0下载:
  2. 自己写的数字电路试验VGA控制器VHDL源代码。-Write your own VGA digital circuit test controller VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:860.53kb
    • 提供者:成才
  1. DDS

    0下载:
  2. DDS正弦波形发生器,VHDL语言描述!-DDS sine waveform generator, VHDL language descr iption!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:860.59kb
    • 提供者:吴江波
  1. counter_99

    0下载:
  2. XINLIX soprtan3 源码,实现计数器功能,可加减计数并在数码管上显示,可调节计数间隔。-XINLIX soprtan3 source code to achieve the counter function, counting and addition and subtraction on the digital display, adjustable counting interval.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:860.77kb
    • 提供者:TSWC
  1. cordicCOS

    0下载:
  2. 用CORDIC算法来实现y余弦运算,并在QUARTUS2中仿真通过,误差较小。-CORDIC algorithms used for cos .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:861.17kb
    • 提供者:叶敏
  1. ModelSim_6.5__Keygen

    0下载:
  2. ModelSim_6.5__Keygen,破解详解-ModelSim_6.5__Keygen, crack Xiangjie
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:861.27kb
    • 提供者:赵岩
  1. dds

    0下载:
  2. 这是用VERILOG描写的一个DDS的实例,涉及到一些lpm的运用希望对大家有用-it‘s useful。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:861.28kb
    • 提供者:tom
  1. cal

    0下载:
  2. 针对CPLD实现简易计算器的程序。全部程序都在了。-cpld cal program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:861.41kb
    • 提供者:zuonan
  1. DAC902

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  2. DAC902测试 Quartus II 实现的-DAC902 test Quartus II implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:861.81kb
    • 提供者:叶才三
  1. EDAshuzipinlvji

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  2. 1)能够测量正弦波、三角波、锯齿波、矩形波等周期性信号的频率; 2)能直接用十进制数字显示测得的频率; 3)频率测量范围:1HZ~10KHZ切量程能自动切换; 4)输入信号幅度范围为0.5~5V,要求一起自动适应; 5)测量时间:T〈=1.5S;6)用CPLD/FPGA可编程逻辑器件实现 -1) capable of measuring the frequency of the sine wave, triangle wave, sawtooth wave, rectangular wave p
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:861.84kb
    • 提供者:安德森
  1. EDA

    0下载:
  2. 其测量范围为1MHz。量程分10kHz,100kHz和 1MHz三档(最大读数分别为9.99kHz,99.9kHz,999kHz)。 被测信号由信号发生器提供。 -The measuring range of 1MHz. Range sub-10kHz, 100kHz and 1MHz third gear (maximum reading for the 9.99kHz, 99.9kHz, 999kHz). The measured signal from the signal generat
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:861.86kb
    • 提供者:安德森
  1. pci9054

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  2. verilog语言实现PCI9054控制-Verilog pci9054
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:862.13kb
    • 提供者:徐沈
  1. fftw3mat

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  2. 介绍了如何利用c语言来实现数字信号处理中常用的fft,并介绍了如何利用matlab验证-intruduce how to use c to finish fft,and use matlba to ensure
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:862.26kb
    • 提供者:黄易飞
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