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  1. 100111210253

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  2. 关于FPGA显示的程序,很实用,希望旅游时间下载,如有合作的请加我-about the code of FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:948.37kb
    • 提供者:my name
  1. ESLA601-User-Manual-v-1.2

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  2. ESLA601 逻辑分析仪手册 1.2 版本 中文.-ESLA601 user manual,chinese v1.2.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:948.38kb
    • 提供者:ioo
  1. Modelsim中文教程

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  2. Modelsim中文教程,有3篇讲Modelsim的资料,对新手是个很好的参考资料-Modelsim Chinese guide, a three stresses Modelsim information, the rookie is a very good reference!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:948.39kb
    • 提供者:温暖感
  1. shiyankaoshi

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  2. eda 实验考试相关题目 包括空调设计 交通灯 计数器 等 -eda practical examination, including air conditioning design related topics such as traffic lights counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:948.41kb
    • 提供者:王晓宏
  1. N2FFT

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  2. C#的FFT程序,非2基的,可以算100点,200点的FFT-C# the FFT program, non-2-based, you can count 100 points, 200 point FFT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:948.45kb
    • 提供者:李丰攀
  1. zhuangtaiji

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  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:948.83kb
    • 提供者:李军
  1. EXP-EPM3128_3256

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  2. cpld/fpga芯片exp-epm3128/3256的详细说明,适用于quartus以及maxplus软件-cpld/fpga chip exp-epm3128/3256 a detailed descr iption of the software for quartus and maxplus
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:949.28kb
    • 提供者:Yolanda
  1. data_selecter

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  2. 数据选择器与同步时序计数器,verilog语言编译,开发平台spartan--data selector
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:949.7kb
    • 提供者:Sam
  1. Clk50M_div_1HZ

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  2. 分频实验,将50M时钟分频为1HZ,输出LED1,闪亮-Crossover experiments, 50M clock divider is 1HZ, output LED1, shiny
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:949.9kb
    • 提供者:徐驰
  1. VHDL_Coding_Style_Guidelines_and_Synthesis

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  2. 对于有多年VHDL编程经验的工程师,如何提高代码可读性,可移植性,就必须关注自己代码的风格。资料为VHDL的代码风格探讨,能够给广大VHDL代码使用者参考-VHDL programming for many years of experience, engineers, how to improve readability, portability, the code must be concerned with their own style. Data VHDL code style dis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:949.92kb
    • 提供者:易星
  1. DDS-signal-generate

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  2. 本文描述了怎样利用DDS(直接数字频率技术)来制作信号发生器-how to generate signal with the use of DDS technology
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:950.04kb
    • 提供者:杨阳
  1. _14_vga_char

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  2. 用VHDL语言实现的在VGA上显示汉字。可显示不同大小的汉字。可以设定字显示的大小。-Using VHDL in VGA display Chinese characters. Can display Chinese characters of different sizes. You can set the size of the word display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:950.12kb
    • 提供者:january
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