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  1. 基于FPGA开发的DTMF信号的产生

    2下载:
  2. 用verilog写的,是基于FPGA的开发,已经成功的仿真过。(Written in Verilog, has been simulated.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-09
    • 文件大小:947kb
    • 提供者:阳光1224
  1. kcu105_sgmii_over_lvds

    2下载:
  2. sgmii use verilog coding,and can work 1000M ethernet
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-03-17
    • 文件大小:947kb
    • 提供者:caohy168
  1. ALU181

    0下载:
  2. 此源代码的功能是CPU中的运算单元的vhdl描述-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:947.3kb
    • 提供者:kenny.iverson
  1. I2C_ise7_bak

    0下载:
  2. Uncomment the following library declaration if instantiating any Xilinx primitives in this code. library UNISIM use UNISIM.VComponents.all I2C DRIVE IN VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:947.32kb
    • 提供者:mehdi
  1. NiosII_IIC_Lab

    0下载:
  2. FPGA,基于NIOSII的IIC的程序-iic program based on niosII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:947.75kb
    • 提供者:付秀泉
  1. zzlB

    0下载:
  2. QUARTUSII 9.0 下的三级流水线中值滤波工程,vhdl源程序等。可用于fpga做图像预处理。-the three stage pipeline median filter project under QUARTUSII 9 , VHDL source program. which can be used by FPGA to do image preprocessing.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:947.85kb
    • 提供者:王伟
  1. FPGA_Designdiscrinple

    0下载:
  2. FPGA/CPLD 数字电路设计经验分享,来源别人的经验和设计技巧。-FPGA/CPLD digital circuit design experience to share, the source of experience and design skills of others.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:947.88kb
    • 提供者:kanmilo
  1. crack_modelsim_6.6d

    0下载:
  2. crack_modelsim_6.6d,最新版modelsim仿真软件-crack_modelsim_6.6d, the latest version of modelsim simulation software
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:947.89kb
    • 提供者:likai
  1. SP3E1600E_picoblaze_nor_flash_prog

    0下载:
  2. Vga Game for xilinx fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:947.96kb
    • 提供者:ramaseshu
  1. FPGA乐曲演奏电路

    2下载:
  2. 乐曲硬件演奏电路设计,采用verilog-VHDL语言编写,使用quartus2开发平台编译仿真(design of music hardware performance circuit(verilogVHDL))
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-09-17
    • 文件大小:948kb
    • 提供者:Dexter_
  1. szz

    0下载:
  2. Verilog编写的数字钟,利用动态扫描在六位数码管上显示,可调时间,在程序中指定的时间报时,蜂鸣器实现。-Digital clock written in Verilog, the use of dynamic scanning of the six digital display, adjustable time, the time specified in the program chime, buzzer achieved.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:948.25kb
    • 提供者:
  1. ps2_vga

    0下载:
  2. 改程序是用VERILOG语言编写的用以实现PS2鼠标实现VGA控制-Change program is written in VERILOG language to achieve VGA control PS2 mouse
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:948.36kb
    • 提供者:张东豪
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