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  1. DC

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  2. 基于VHDL的数字时钟,包含设置时间,闹钟,以及整点报时的功能。设置时间和闹钟时数码管闪烁。-Based on VHDL digital clocks, including setting time, alarm clock, and the function of the time on the hour. Set a time when the alarm clock and digital tube twinkle.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.21mb
    • 提供者:miffy
  1. digital-frequency

    0下载:
  2. 数字频率计 采用Verilog语言编写,分为8个模块,分别是计数器,门控,分频,寄存器,多路选择,动态位选择,BCD译码模块-Digital frequency meter using Verilog language, divided into eight modules, namely, the counter, gated, frequency, register, multiplexer, Dynamic Choice, BCD decoding module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.21mb
    • 提供者:multidecoder
  1. UpdateApp1.2

    0下载:
  2. 这是FPGA的升级程序,C#发送bin文件给FX3,然后FX3再把数据通过SPI通信发送给FPGA-This upgrade program the FPGA, C# FX3 sent to the bin, and then FX3 data to the FPGA via SPI communications
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-11
    • 文件大小:1.21mb
    • 提供者:buptlw
  1. eetop.cn_Hspice.ppt

    0下载:
  2. 电路设计和仿真工具hspice的重要使用文档。无师自通-Circuit design and simulation tools hspice important use of documents. Without a teacher
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.21mb
    • 提供者:yuzhen
  1. FPGA1

    0下载:
  2. 基于FPGA的多路复用器,4通道8位带三态类型-Multiplexer, 4 channel 8 bits with three states type
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.21mb
    • 提供者:董婷
  1. SDR

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  2. 直接序列扩频通信的Verilog仿真代码,在Quartus II中实现。-Direct sequence spread spectrum communication Verilog simulation code, implemented in Quartus II.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.21mb
    • 提供者:liuqian
  1. xilinxusb

    1下载:
  2. xilinx USB 下载线资料与程序, -xilinx USB download cable data and procedures, many money to buy the
  3. 所属分类:VHDL编程

    • 发布日期:2013-03-06
    • 文件大小:1.21mb
    • 提供者:lv ying qin
  1. traffic

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  2. 交通灯设计,功能包括:东西南北灯变化以及紧急情况时手动控制四个方向红灯全亮。之后返回中断状态继续。-Traffic light design and features include: East and West when the lights change, and an emergency manual control all four directions red light. And then returned to break the state to continue.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.21mb
    • 提供者:chenkan
  1. 11111111

    0下载:
  2. 用于高速高精度ADC的时钟稳定电路研制,提出一种稳定高速的ADC时钟方案-Used for high speed and high precision clock stable development ADC circuit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.21mb
    • 提供者:张维琛
  1. chuzuche5

    0下载:
  2. 本程序详细的描述了出租车计费器,可直接应用。-This procedure is detailed procedures for the taxi meter can be directly applied.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.21mb
    • 提供者:杨剑
  1. vga_pic

    0下载:
  2. 利用verilog编写的程序,并且实例化了一个rom,将mif文件初始化在rom中,可以实现在vga上显示图片。文字信息等,十分实用。-Use programs written in verilog, and instantiates a rom, rom the mif file initialization, you can achieve the vga display picture. Text information, very useful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.21mb
    • 提供者:灵湖仙梦
  1. susliks-project

    0下载:
  2. 基于逻辑门的打地鼠游戏,其中设置了三关,每关出现八个地鼠-playing susliks with logic gate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.21mb
    • 提供者:风云
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