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  1. clock

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  2. 该程序是用嵌入式开发的一个多功能数字钟,可以实现正常的计时,倒计时,闹钟,始终调整,整点报时功能-The program is the development of a multi-function embedded digital clock, can achieve a normal time, countdown, alarm clock, and always adjusting, the whole point timekeeping function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:65.03kb
    • 提供者:liulingling
  1. dayin

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  2. 该程序利用vhdl语言,采用查表法实现am调制,此方法简洁又有效-The program using vhdl language, using look-up table method to achieve am modulation, this method is simple and effective
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:65.02kb
    • 提供者:rain
  1. ise_keygen7.1-8.1-9.1

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  2. 赛灵思的ise718191的lic-xilinxs ise718191 lic。。。。。。。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:65.02kb
    • 提供者:王蒙
  1. shiboqiTFT

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  2. 此程序是用单片机控制产生简单的信号即简单的信号发生器并用TFT彩屏进行显示-This program is simple to use MCU control signals that produce a simple signal generator and to display with TFT color screen
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:65.01kb
    • 提供者:王朋
  1. 16-Bit_RCA

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  2. 16 bit Ripple Carry Adder using vhdl on modelsim
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:65kb
    • 提供者:gngr3934
  1. 1_switch

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  2. a switch control for motor and keypad using keil for lpc2148
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-09
    • 文件大小:65kb
    • 提供者:bunny@
  1. ADC的核心指标(SINAD,ENOB等)

    0下载:
  2. ADC采样性能分析,核心指标等。及一些测试方法。(Analysis of ADC sampling performance)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-30
    • 文件大小:65kb
    • 提供者:qeer
  1. VHDLaTUTORIAL

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  2. vhdl tutorial of this
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:65kb
    • 提供者:pcjoshi
  1. AVR_Core.tar

    0下载:
  2. CPLD例程(语言)\《Verilog HDL数字控制系统设计实例》\AVR_Core.tar.gz-.rar-CPLDprogram dialogue /Verilog language design examples
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:64.99kb
    • 提供者:spring
  1. proteus_lcd1602

    0下载:
  2. 字符_LCD和proteus仿真两个文件——可以实现仿真-Proteus simulation character _LCD and two files- can simulate ~ ~ ~
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:64.99kb
    • 提供者:连连
  1. VHDL-(3)

    0下载:
  2. Introduction to the language - simple examples n VHDL’s model of a system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:64.99kb
    • 提供者:Ali
  1. nios_II_lab

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  2. 采用nios2的嵌入式数字钟的设计与实现,首先使用quartus2中的sopc builder设计CPU内核,然后在nios2中庸C语言来实现数字钟的功能-The use of embedded digital clock nios2 the design and realization of the first to use quartus2 in sopc builder design CPU core, and then nios2 Zhongyong C language to real
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:64.96kb
    • 提供者:齐磊
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