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  1. fft.c

    0下载:
  2. C语言实现快速傅立叶变换,大家可以参考一下!-C language Fast Fourier Transform, we can take a look!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.14kb
    • 提供者:郭子荣
  1. The-whole-point-of-time

    0下载:
  2. 整点报时with流水灯可调时分可调显示星期-The whole point of time with water lights around adjustable adjustable shows a week
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:2.14kb
    • 提供者:蔡宇佳
  1. THREEFLIFT

    0下载:
  2. 基于VHDL语言的三层电梯控制器,经过个人修改,更加完善-VHDL language based on three elevator controller, through personal changes, more perfect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:2.14kb
    • 提供者:JASON
  1. VHDL

    0下载:
  2. vhdl分频代码,只需改变里面的常数即可,改变分频系数-vhdl frequency code, just a constant which can be changed to change the frequency factor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.14kb
    • 提供者:atom wang
  1. I2C_C51

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  2. I2C总线驱动代码!采用KEIL编译,采用语言为C51-I2C bus driver code! Using KEIL compiler, using the language for the C51
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.14kb
    • 提供者:liuguang
  1. ADC

    0下载:
  2. verilog At the last, before starting fist go through the FPGA NEXYS2 Board manual. It will be useful for you for this interfacing and also for the future. Best of luck…, try this one because practice makes man perfect. And, yes also if you have a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.14kb
    • 提供者:sid
  1. NIOS_Basic

    0下载:
  2. NIOS相关的基础实验的代码,SYSCLK,TIMESTAMP,LED,SDRAM,INT-NIOS basic experiments related to code, SYSCLK, TIMESTAMP, LED, SDRAM, INT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.14kb
    • 提供者:李纪楷
  1. 4

    0下载:
  2. Visual Basic 编写的,为程序增加扫描功能-Written in Visual Basic, in order to increase the scanning process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.13kb
    • 提供者:lang ge
  1. 5fenpinqi

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  2. 实现5分频的分频器程序,并且使用仿真文件进行测试通过。-5 frequency divider program, and tested through simulation file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:2.13kb
    • 提供者:杨鹏飞
  1. dada

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  2. ad数据采集 一路的AD数据采集 使用状态机控制AD时序-data collection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:2.13kb
    • 提供者:谢景磊
  1. RS232

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  2. RS232 用vhdl语言实现,很有用-RS232 with a vhdl language, very useful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.13kb
    • 提供者:yuexinqi
  1. sd_crc7_c16

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  2. sd crc7 crc16 校验 verilog实现-sd crc7 crc16 verilog
  3. 所属分类:VHDL编程

    • 发布日期:2017-11-06
    • 文件大小:2.13kb
    • 提供者:李红敏
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