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  1. xilinxOFDM

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  2. xilinx OFDM书中的完全代码,可参照其中设计整个OFDM系统-xilinx OFDM complete code book can be designed with reference to the OFDM system which
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.61mb
    • 提供者:王超
  1. CORDIC_FPGA

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  2. 摘要:本文在传统CORDIC算法的基础之上,通过增加迭代次数,对参数进行了优化筛选, 提高了运算精度,使设计出的软核能够在精度要求较高的场合中运行,如实时语音、图 像信号处理、滤波技术等。输出数据经过IEEE-754标准化处理,能够直接兼容大多数处 理器,扩展了其应用范围。最终在Altera公司NiosⅡ处理器中通过增加自定义指令的方 式完成了硬件实现。 关键字:CORDIC ,自定义指令, IEEE-754标准化处理。-Abstract: In this paper, ba
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:223.35kb
    • 提供者:daisywmc
  1. CPLD-basedfrequencymeter

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  2. 基于CPLD的复杂多功能频率计设计,实现测周期,测频率测占空比的功能-CPLD-based multi-functional and so the design of precision digital frequency meter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:654.52kb
    • 提供者:廖卫
  1. code

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  2. clk_sys为输入时钟,rst为复位信号,clk_out为输出分频时钟,div_num为分频数目。多少分频就把div_num赋多少值。-awet.etr.ert.ewtewjtr eqtr ert ert ewr erwrt ewrt ret5 asd er.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:759byte
    • 提供者:happybrave
  1. 74LS

    0下载:
  2. 数字逻辑与系统的关于所有的器件74LS的介绍,功能表-Digital Logic and System devices 74LS on the introduction of all the menu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.53mb
    • 提供者:万淑红
  1. SDRAM

    0下载:
  2. 介绍了sdram的原理,非常详细,可以供学习者和开发者参考-Introduced the principle of sdram, very detailed, you can reference for learners and developers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.85mb
    • 提供者:萤火之光
  1. bookForEDA

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  2. EDA实验中的实验指导书,包含常见的几个实验,硬件、vhdl-book form eda/vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:215.89kb
    • 提供者:李寡妇
  1. usb1.1

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  2. USB 1.1的verilog代码,已通过fpga 程序源代码内容-Verilog code for USB 1.1, has passed through the contents of the source code fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:62.24kb
    • 提供者:huipengliu
  1. Turbodecoders

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  2. it consist of decoding of turbodecoders
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:395.59kb
    • 提供者:manu
  1. timer_led

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  2. nios2 IDE ,时钟程序,实现其主要功能如下:1.在液晶屏上显示时间、日期、状态提示;2.在控制台上显示时间、日期、状态提示;3.对时间、日期能够进行设置;4.在8位七段显示器上显示时间、日期;5. 整点报时功能(利用LED闪烁提醒)。请根据请添加的cpu系统更改其中的调用名称。-nios2 IDE, clock procedures to achieve its main function is as follows: 1. Displayed on the LCD screen tim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3.42kb
    • 提供者:cd
  1. counter

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  2. VHDL常用的计数器模块,包括各种类型的计数器,可供参考-commonly used VHDL modules, including counters, decoders, encoders, latches, etc., can be used as reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:838byte
    • 提供者:nie
  1. VerilogHDL

    0下载:
  2. Verilog HDL的基本语法 Verilog HDL的基本语法-Verilog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:362.93kb
    • 提供者:林海
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