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  1. i2c_vmm_user

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  2. systemverilog 测试文档,怎样使用这个预言来测试你要的功能,很强大,和C++比较相似-systemverilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:567.65kb
    • 提供者:haichao
  1. aybook.cn_xinrdksfks0630

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  2. 关于嵌入式系统设计的比较经典的教程,实用性强-Comparison of embedded system design on the classic tutorials, practical
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.61mb
    • 提供者:wj
  1. 05_CRC

    0下载:
  2. Source code to calculate the CRC of an incoming sequence of X bits.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:220.83kb
    • 提供者:jesortsan
  1. led_driver

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  2. LED display verilog code. to generate clocks and wishbone interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:1.73kb
    • 提供者:r_ansal
  1. VerilogHDL_CLASSIC

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  2. Verilog 经典试题,题目有相当的难度,可以用来检验学习成果-Verilog exam
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:72.03kb
    • 提供者:yangfan
  1. FFTs_in_FPGAs_and_ASICs

    0下载:
  2. - FFTs_in_FPGAs_and_ASICs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:47.96kb
    • 提供者:huuhung
  1. CORDIC_sin_cos

    0下载:
  2. - CORDIC for sine co mputation- - CORDIC for sine cosine computation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:280.8kb
    • 提供者:huuhung
  1. A_Programming_Example_Large_FFT

    0下载:
  2. - A Programming Example_Large FFT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:67.09kb
    • 提供者:huuhung
  1. EDA

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  2. EDA数字时钟设计程序报告-EDA数字时钟设计程序报告!!!!!!!!!!!!!!!!!!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:284.11kb
    • 提供者:WEB
  1. filter_VHDL

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  2. 用VHDL语言实现滤波的设计,并通过modelsim仿真!用matlab产生输入结果,并与matlab输出结果比较是相同的.-Filter by language VHDL design and simulation through modelsim! Results with matlab generate input and output compared with the matlab are the same.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:339.35kb
    • 提供者:weihli
  1. FPGA

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  2. 其中包含一些以前学习时写过的各种加法器和HDB3编码,以及状态机的一些题目-Which contains a number of previously written a variety of learning adder and HDB3 encoding, and the state machine of some of the topics
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.13mb
    • 提供者:yuandb
  1. comparator

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  2. 8位二进制的数值比较器,这是用verilog hdl语言中的行为建模写的-8-bit binary value of the comparator, which is used in the verilog hdl behavioral modeling language to write
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:143.74kb
    • 提供者:黄启
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