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de2_lcm_ccd_sram
- 这是altera公司DE2的lcm-ccd-sram的代码，希望对大家编写有用-this code based on the altera DE2 board
NIOS-SOPC
- NIOS 软核 教程 基于NIOS的SOPC设计与实践-NIOSII using FPGA
IIR_Filter
- 一个简要的低通滤波程序IIR Filter QuartusII7-IIR Filter QuartusII7
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- 基于quartus的，状态机实现流水灯，verilog HDL语言编写-Quartus-based, the state machine to achieve water lights, verilog HDL language
VerilogCode
- 本代码是在做verilog程序开发时，可以应用的一些小模块，直接应用可缩减开发的周期。-The verilog code to do the procedure in the development, can be applied to a number of small modules that can be directly applied to reduce the development cycle.
shiyan7
- EDA 2000 VHDL 试验箱 试验七源代码,LCD显示控制设计。 -EDA 2000 VHDL source code for the seven test chamber, LCD display control design.
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- bit append16 VHDL source code
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- Timer verilog RTL code
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- Watchdog timer verilog RTL code
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- 华为_QuartusII指南，华为_QuartusII指南华为_QuartusII指南-华为_QuartusII指南华为_QuartusII指南华为_QuartusII指南
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- 本部门所承担的FPGA设计任务主要是两方面的作用：系统的原型实现和ASIC的原型验证。编写本流程的目的是： l 在于规范整个设计流程，实现开发的合理性、一致性、高效性。 l 形成风格良好和完整的文档。 l 实现在FPGA不同厂家之间以及从FPGA到ASIC的顺利移植。 便于新员工快速掌握本部门FPGA的设计流程
xapp860
- 16通道DDR的LVDS接口（VHDL,Verilog and doc）-16-Channel, DDR LVDS Interface with Real-Time Window Monitoring