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  1. ASSIGNMENT3

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  2. Implementation of risc processor program in verilog coding.-Implementation of risc processor program in verilog coding.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:115.58kb
    • 提供者:poo
  1. SEG7_LUT_8

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  2. terasic的DM9000A模块源码,使用nios2做以太网应用的应该会用到-terasic the DM9000A module source, use nios2 do Ethernet applications should be used
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:11.78kb
    • 提供者:llwww
  1. zcjj

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  2. 该算法使用于AD转换,它是运用EDA技术通过对逐次渐进法进行编程实现的,运算快速,正确率高-The algorithm uses the AD converter, it is the use of EDA technology through programming on a successive approximation method, fast computing, the correct rate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:225.3kb
    • 提供者:谭林
  1. freq_meter

    0下载:
  2. 使用verilog写的频率计,可切换档位-Frequency counter using verilog write switch stalls
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:1.19mb
    • 提供者:Engr.Echo
  1. Frequency8bit-OK

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  2. 8位频率计 CPLD VHDL EMP570 ALTERA-Frequency8bit CPLD VHDL EMP570 ALTERA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:307.1kb
    • 提供者:zhaochao
  1. led

    0下载:
  2. 实现流水灯的设计,在ISE8.2下进行开发!芯片为virtex4-Design of light water
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:567.98kb
    • 提供者:冯丽洋
  1. project

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  2. 采用底层设计懂得乘法累加器一般设计方法,对于VHDL相关应用有一定帮助-Know how to multiply-accumulator general design method, the underlying design VHDL related applications
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:3.51mb
    • 提供者:YH
  1. led_keyscan

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  2. verilog文件写的微动按键拨码开关检测代码-verilog file micro key DIP switch detection code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:913byte
    • 提供者:盛瑞
  1. chenyu--chengxu

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  2. 利用verilog语言编写的RS232转换到RS485程序,实现总线通信-Verilog language converted to RS485 RS232 bus communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:193.02kb
    • 提供者:张思文
  1. Pipeline-2.zip

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  2. Pipeline processor verilog components ,Pipeline processor verilog components
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:2.77kb
    • 提供者:Aria
  1. vhdl-pipeline-mips_latest

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  2. pip-lined MIPS in vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:1.09mb
    • 提供者:sakthivel.p
  1. KEY

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  2. 用VHDL语言来实现扫描键盘值,并在数码管上显示-VHDL language to achieve scanning keyboard and display on the digital
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:690.65kb
    • 提供者:田天
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