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  1. 9_ImageMorphologic

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  2. 基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,图像形态学部分,腐蚀,膨胀,细化算法-System Generator based image processing engineering, multimedia processing FPGA implementation source code, image morphology section, corrosion, swelling, thinning algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:8.28mb
    • 提供者:wan
  1. BPSK

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  2. bpsk modulation and demodulatiom
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:472.99kb
    • 提供者:nguyen tien luc
  1. 10_ImageEdge

    0下载:
  2. 基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,图像边缘提取-System Generator based image processing engineering, multimedia processing FPGA implementation source code, image edge extraction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.46mb
    • 提供者:wan
  1. 6_ImageBasic

    0下载:
  2. 基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,图像基本操作,几何变换,直方图,灰度化处理等-System Generator based image processing engineering, multimedia processing FPGA implementation source code, the basic operation of the image, geometric transformations, histogram, gray p
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:13.84mb
    • 提供者:wan
  1. 13.2_MotionDetec

    0下载:
  2. 基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,基于视频的运动检测-System Generator based image processing engineering, multimedia processing on FPGA source code, based on video motion detection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.7mb
    • 提供者:wan
  1. cic5r61

    0下载:
  2. 实现CIC5级滤波器功能。可以达到提亲一位或者延迟一采样的功能-Achieve CIC5 stage filter function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:865byte
    • 提供者:lihe
  1. FPGA_CIC

    0下载:
  2. 用Count计数法实现5级CIC滤波器,能够提前或者延迟一个周期采样。能综合-Implementation level 5 CIC filter with Count counting method, one can advance or delay the sampling period.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:767byte
    • 提供者:lihe
  1. Verilog_Spike_Filter

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  2. 实现Spike—滤波器的功能,可以经过quartus软件综合,然后映射到FPFGA上面-Achieve Spike-filter function, the software can be integrated through quartus then mapped to FPFGA top
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:10.01kb
    • 提供者:lihe
  1. multi_CX

    0下载:
  2. 实现multi-CX的功能,可以经过quartus软件综合,然后映射到FPFGA上面-Achieve multi-CX features, the software can be integrated through quartus then mapped to FPFGA top
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:20kb
    • 提供者:lihe
  1. ycrcb2rgb.v

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  2. 用verilog编写的最简单的YUV转rgb的代码,请大家参考-yuv2rgb,by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.54kb
    • 提供者:牛虻
  1. demo3

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  2. 双通道PWM信号发生器,Verilog编写,带时能输出端-PWM TRANCER by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:411.48kb
    • 提供者:金怡胜
  1. JPEGBMPMIF

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  2. 在FPGA开发下,可以帮助从JPEG或者BMP转换为MIF文件格式,具有很好的帮助FPGA开发-In FPGA development can help convert from JPEG or BMP file formats MIF has good help FPGA development
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:271.48kb
    • 提供者:庄晓奇
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