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  1. mdi_o

    0下载:
  2. 这个是mdio的源码程序,可以拿来直接用-this is mdio program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.41kb
    • 提供者:王风
  1. 1602LCD_Verilog

    0下载:
  2. 1602 显示的Verilog程序源码 很容易理解-Verilog 1602 display program source code is easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:395.77kb
    • 提供者:changrenhe
  1. lab1_4bitsLEDs_4

    0下载:
  2. 使用verilog语言设计实现 -流水灯实验 -The use of Verilog language design and Implementation- light water experiment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.23mb
    • 提供者:sinahust
  1. LED_RUN

    0下载:
  2. verilog 流水灯程序 简单易懂 很好-verilog Light water program easy to understand well
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:173.91kb
    • 提供者:changrenhe
  1. BCDma-verilog

    0下载:
  2. 二进制转bcd码,很好理解,适合新手用,可以学习学习-Bcd binary switch code, well understood, suitable for novice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:216.35kb
    • 提供者:changrenhe
  1. siwei

    0下载:
  2. si wei bijiaqi de verilog daima
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:205.04kb
    • 提供者:changrenhe
  1. RSdecoder

    0下载:
  2. 自己写的基于verilog的RS译码器,能够实现RS(240,224)码译码,一级流水设计,可连续译码也可非连续译码。-RSdecoder for RS(240,224).
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:11.4kb
    • 提供者:opudn89
  1. dwt_32

    0下载:
  2. Haar wavelet for an image of 32*32.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1005byte
    • 提供者:Rishi
  1. examples

    0下载:
  2. Code on Debouncer, ripple carry adder, Sequence detector, huffmann encoder and some more examples in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-23
    • 文件大小:6.43mb
    • 提供者:SUDHIR
  1. jpegencoder

    0下载:
  2. jpeg encoder in vhdl including modules MAC, Wavelet encoder, filter bank, image to text converter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.75kb
    • 提供者:SUDHIR
  1. run_led

    0下载:
  2. verilog顺序操作实现三个LED灯轮流闪烁,产生流程等的效果。-verilog sequential operations to achieve three LED lights flashing alternately, processes, etc. to produce results.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.27kb
    • 提供者:陈忠德
  1. key_detect

    0下载:
  2. 由verilog编写的简单的按键消抖模块。主要是由“电平检查模块”和“10ms延迟模块”组合合成。-Verilog prepared by the simple key debounce module. Mainly synthesized by a combination of level examination module and module 10ms delay
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.5kb
    • 提供者:陈忠德
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