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  1. traffic

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  2. 利用vhdl编写的模拟交通灯的程序,调试成功,欢迎大家使用。-Prepared by the use of VHDL simulation of traffic lights procedures, debugging success, welcome to use.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1013.11kb
    • 提供者:0508140110
  1. xuliejiancesheji

    0下载:
  2. 用状态机实现一序列检测器,即检测到串行码{1110010}后,检测器输出1,否则输出0; -State machine used to achieve one sequence detector, which detects the serial code (1110010), the detector output 1, otherwise output 0
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:46.51kb
    • 提供者:lei
  1. VHDL

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  2. 自己收集的VHDL例程代码,适合初学者学习用,希望能给大家带来帮助。-Collected their own routines VHDL code, suitable for beginners to learn, I hope we can help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:535.24kb
    • 提供者:杨少栋
  1. led

    0下载:
  2. 适用于FPGA初学者,一个流水灯的程序,用VERILOG语言写的.-Applicable to FPGA beginners, a procedure for light water, using the Verilog language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:212.96kb
    • 提供者:
  1. S9_PS2_LCD

    0下载:
  2. 键盘输入液晶模块显示字符,在液晶显示屏上显示从PS2键盘输入的字符-Keyboard input LCD display module characters displayed in the LCD screen from the PS2 keyboard input characters
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:748.54kb
    • 提供者:zl.yin
  1. S10_PS2_RS232

    0下载:
  2. 键盘输入串口输出显示字符,通过串口显示键盘输入的字符-Keyboard input serial output display characters, the keyboard input through serial display characters
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.53mb
    • 提供者:zl.yin
  1. S12_AudioLoopback_DAV_MIC

    0下载:
  2. 从MIC输入一段音频然后,再从AOUT的接口播放出来的verilog 的代码-Input from the MIC for some audio and then AOUT interface from broadcast in the Verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.3mb
    • 提供者:zl.yin
  1. S13_VIDEO_IN_AV

    0下载:
  2. AV视频信号输入后,存入SDRAM中然后在PC上面进行显示的代码。-AV video signal input into the SDRAM in the PC and then display the code above.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.18mb
    • 提供者:zl.yin
  1. biaojueqi

    0下载:
  2. 这是一个用VHDL语言实现的非常实用的表决器-This is a VHDL language with the very practical voting machine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:324.29kb
    • 提供者:解冰
  1. clk

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  2. just division the clock into 2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:23.9kb
    • 提供者:zhuning
  1. HDLC_g

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  2. HDLC的一些相关文档,可能对HDLC设计有很大的帮助!-HDLC some relevant documents, HDLC design may be very helpful!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:46.05kb
    • 提供者:guolh
  1. vhdl100

    0下载:
  2. 很多VHDL例子,没有测试,供大家参考-VHDL many examples, there is no test, for your reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:313.25kb
    • 提供者:guolh
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