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  1. VGA_controller

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  2. VGA显示控制的VHDL源码,可控制VGA显示器RGB三色,显示出各种图案。-VGA display and control of the VHDL source code, can control the RGB three-color VGA display, showing a variety of patterns.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:386.3kb
    • 提供者:ilovethisgam
  1. PS2_kebord_controller

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  2. PS2键盘控制器的VHDL源码,用FPGA直接读取键盘的输入并显示。-PS2 keyboard controller VHDL source code, with a direct FPGA to read keyboard input and displayed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:826.15kb
    • 提供者:ilovethisgam
  1. nios

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  2. 用nios系统实现流水灯的设计,直接带工程文件,好用-use nios system to do the light disgn,it compose the design‘s project。very good!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5.06mb
    • 提供者:qina
  1. p2r_CordicPipe

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  2. p2r vhdl code for general use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.38kb
    • 提供者:xyz002
  1. p2r_cordic

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  2. p2r code in VHDL program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:802byte
    • 提供者:xyz002
  1. lut_core

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  2. LUT core in VHDL program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.67kb
    • 提供者:xyz002
  1. Advancedcontrolsystems

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  2. archive of advanced control systems
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:591.16kb
    • 提供者:xyz002
  1. Chapter-stuff

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  2. FPGA class notes - overheads
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.24mb
    • 提供者:xyz002
  1. Designs

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  2. design files in verilog, alu, array mult, carry shift etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:37kb
    • 提供者:p2p_123
  1. dsp_ohp

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  2. Digital signal processing overhead slides in post scr ipt format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:587.87kb
    • 提供者:p2p_123
  1. LampsSequencer

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  2. FPGA开发,ALTERA的EP2C5实验平台,制作流水灯程序VHDL-FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.1kb
    • 提供者:zhouxin
  1. DigitalClock

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  2. 用EDA仿真软件做的一个数字钟设计实验,能够实现小时、分钟、秒的60进制计时。是我的课程设计全部源码哦~-EDA simulation software to do with a digital clock design experiments, to achieve hour, minute, second of 60 Hex timing. Curriculum design is all the source code of my oh
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:178.4kb
    • 提供者:王子涵
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