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  1. final

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  2. vhdl编写的控制vga显示器显示条形信号-vhdl vga write control signal bar display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.09kb
    • 提供者:李一峰
  1. step_motor

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  2. 步进电机是一种能够将电脉冲信号转换成角位移或线位移的机电元件,它实际上是一 种单相或多相同步电动机。单相步进电动机有单路电脉冲驱动,输出功率一般很小,其用途 为微小功率驱动。多相步进电动机有多相方波脉冲驱动,用途很广。使用多相步进电动机时, 单路电脉冲信号可先通过脉冲分配器转换为多相脉冲信号,在经功率放大后分别送入步进电 动机各相绕组。每输入一个脉冲到脉冲分配器,电动机各相的通电状态就发生变化,转子会 转过一定的角度(称为步距角)。正常情况下,步进电机转过的总角度和
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:951byte
    • 提供者:ken
  1. viterbi_decoder

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  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.42mb
    • 提供者:卢平
  1. VerilogHDL

    0下载:
  2. 关于VHDL语言的经典讲解,对初学者有很大帮助。-VHDL language on the classic explanation, very helpful for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:3.98mb
    • 提供者:haha
  1. vga_game_demo

    0下载:
  2. vga显示代码 通过片子来显示vga图像-vga display vga code to display the image through the film
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.88mb
    • 提供者:jianqingfeng
  1. EP3C25

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  2. 此文档很重要,是一款最新fpga的文档,很好用的,封装业比较小,功耗低-This document is important, is the latest fpga document, useful, and packaging industry is relatively small, low power consumption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:515.68kb
    • 提供者:李雪
  1. vhdl_max_flash

    0下载:
  2. Max系列对falsh编程的vhdl实现流程-Max series realization of the falsh vhdl programming process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:140.16kb
    • 提供者:gbh
  1. booth

    0下载:
  2. 一个booth乘法器的小例子, 有助于理解booth算法-An example for a booth multiplier in Verilog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:757byte
    • 提供者:mirror
  1. delta-sigma

    0下载:
  2. 关于delta-sigma调制器的详细教程
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:261.44kb
    • 提供者:dsahd
  1. FPGA

    0下载:
  2. 列举了部分无线通信FPGA的VHDL程序。仅供参考。-Lists some of the wireless communication FPGA-VHDL program. For reference only.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:156.91kb
    • 提供者:姜明新
  1. sdram_controller_latest.tar

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  2. sdram_controller_latest.tar.gz -it is memory DDR controller, but it has 8 bit only data bus wide ,and hasn’t independents clock for source read-write data and ddr + controller size. Wrote on the VHDL language.-sdram_controller_latest.tar.gz -it is me
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:30.5kb
    • 提供者:Andrei
  1. wb_async_mem_bridge_latest.tar

    0下载:
  2. wb_async_mem_bridge_latest.tar.gz- it is controller without independents sources clock . Only write or read case synchronization for WB controller interface bus.(computable with WB interface protocol).-wb_async_mem_bridge_latest.tar.gz- it is control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:71.53kb
    • 提供者:rozenan
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