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  1. clock

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  2. 实现FPGA的数字钟的实现,具有小时、分、秒等功能-FPGA digital clock, with hour, minutes, seconds and other functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:663.59kb
    • 提供者:周健
  1. XC2S200PQ208

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  2. xilinx FPGA xc2s200 的技术资料-xilinx FPGA xc2s200 technical information
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:663.67kb
    • 提供者:lv ying qin
  1. nios2_hardware_tutorial

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  2. NiosII硬件开发指南,同样可以到Altera官方网站下载最新版的turorial nios2_hardware_tutorial-nios2_hardware_tutorial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:663.74kb
    • 提供者:weiw
  1. c822.rar

    0下载:
  2. 关于FPGA的一个设计,用FPGA来实现数字示波器,采样时钟为250M,On a FPGA design, FPGA to realize digital oscilloscope, the sampling clock for the 250M
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:664.02kb
    • 提供者:zengxianzhou
  1. LCD12864

    2下载:
  2. FPGA 12864液晶显示屏 汉字显示实例教程-FPGA 12864 LCD Chinese display examples tutorial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-26
    • 文件大小:664.17kb
    • 提供者:苏有路
  1. cordic

    0下载:
  2. 通过VHDL实现 cordic算法,使用的单片机为basys2-By CORDIC to achieve VHDL algorithm, the use of the microcontroller is basys2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:664.18kb
    • 提供者:litianchu
  1. Wolfson-WM8731-audio-CODEC

    0下载:
  2. audio codec data sheet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:664.2kb
    • 提供者:Venky
  1. character-rotation-on-multiple-7segment-displays.

    0下载:
  2. character rotation on multiple 7segment displays by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:664.62kb
    • 提供者:nedved
  1. test_uart2

    0下载:
  2. 可以实现串口收发,能够通过数码管显示从PC机上输入的数据-Serial transceiver, the number of input data from the PC through the digital display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:664.96kb
    • 提供者:李刚
  1. dzq

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  2. 利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计-Use hardware organ NC divider design. Hardware electric circuit module design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:664.98kb
    • 提供者:asd
  1. SAR-ADC

    1下载:
  2. Complete Successive approximation Analog to digital converter along with the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-12
    • 文件大小:665.15kb
    • 提供者:Ramya
  1. fs_re

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  2. 超声波脉冲发射和计时程序,脉冲串个数和周期可设置-Ultrasonic pulse transmission and timing program,pulse sequence number and cycle can be set up
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:665.28kb
    • 提供者:李晶
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