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  1. uart2bus_latest

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  2. 用于fpga并口连接的工程哈,请大家支持一下-For fpga parallel port connection works Kazakhstan, support for what
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.15mb
    • 提供者:sun
  1. exp1_CountWithMemory

    0下载:
  2. 用Altera—DE2板实现秒表的功能,该秒表具有一个复位按钮,两个暂停按钮和两个记录按钮。-Stopwatch function using Altera-DE2 board, the stopwatch has a reset button, two buttons and two recording pause button.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.15mb
    • 提供者:James
  1. SegSimplified

    0下载:
  2. 本工程使用verilog HDL和vivado2014集成开发环境实现利用xilinx Basys3开发板上4位数码管显示从0到9999的计数器功能。-This project uses verilog HDL to realise counting 0 to 9999 on the 7-seg LED loaded on Xilinx Basys3 board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.15mb
    • 提供者:姚罡
  1. Principles_of_Verifiable_RTL_Design

    0下载:
  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.16mb
    • 提供者:杨力
  1. RGB

    0下载:
  2. 用VHDL语言实现将Bayer格式图片转为RGB格式图片-The function of the program is to transfer the Bayer picture into RGB picture
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.16mb
    • 提供者:Mr liu
  1. Principles-of-Verifiable-RTL-Design

    0下载:
  2. RTL设计的基本方法,帮助掌握RTL编码方法-RTL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.16mb
    • 提供者:cuixx
  1. ISCAS85aISCAS89

    2下载:
  2. Verilig of ISCAS85 and ISCAS89
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:1.16mb
    • 提供者:wangnant
  1. rapport_vhdl

    0下载:
  2. Projet fréquencemetre réalisé en VHDL et implimenté sur la carte FPGA Cyclone -Projet fréquencemetre réalisé en VHDL et implimenté sur la carte FPGA Cyclone II
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.16mb
    • 提供者:Youssef
  1. logic_app

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  2. 中际赛微15期培训班 逻辑功能试验 2009-5-Competition in 15 micro-logic function tests training 2009-5
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.16mb
    • 提供者:xinzhi
  1. Drivers_USB_TELIUM-PC

    0下载:
  2. usb ingenico driver EFT930 for win xp
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.16mb
    • 提供者:kira
  1. bijiaoqi

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  2. verilog 9位数 3乘3 窗口比较器
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.16mb
    • 提供者:左振鹏
  1. canbus

    0下载:
  2. can总线的开发和设计,基于FPGA,很强大-can bus development and design, based on FPGA, very powerful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:1.16mb
    • 提供者:xiaolou
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