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  1. ads7844

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  2. ADS7844 AD转换芯片的VHDL控制器-ADS7844 AD converter chip VHDL controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32mb
    • 提供者:tom
  1. ads7844

    0下载:
  2. 本源码介绍了ADS7844 AD转换芯片的VHDL控制器。
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:1.32mb
    • 提供者:周生
  1. altera_solution

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  2. altera的timing约束文档,很有帮助
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.32mb
    • 提供者:back1202
  1. systolic--matrix-inversion

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  2. DSP算法架构及设计,内容为基于systolic的上三角矩阵求逆电路的实现,里面有详尽的MATLAB/SIMULINK 仿真模型,及HDL代码和在modelsim中的仿真程序,非常不错的。-Architecture and design of DSP algorithms, based on systolic upper triangular matrix inverse circuit to achieve detailed MATLAB/SIMULINK model and the HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32mb
    • 提供者:
  1. practica_2

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  2. cruce de semaforo con sensor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.32mb
    • 提供者:javijavi
  1. VHDL_Coding_Style

    0下载:
  2. VHDL编程风格,在MAXplusII上的应用,包括综合器的设置,设计性能分析等
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.32mb
    • 提供者:李芸
  1. zigbee_sensor

    0下载:
  2. ZigBee无线模块实验.rar;基于FPGA-2C35核心;博创实验箱平台。 在quartusII里面添加uart核,利用串口与主控制机相通信,获取从控制机上传感器的的温度、湿度、光敏电阻、热敏电阻等信息(其中主控制机与从控制机是通过zigbee协议通信) -ZigBee wireless module experiment rar core on the FPGA-2C35 Borch experimental box platform. Add uart nuclear qua
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32mb
    • 提供者:
  1. nLint_Quick-Start

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  2. nLint入门教程 包括如何设置nLint的规则 等各种-nLint Introduction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.32mb
    • 提供者:fastwind
  1. 2.ps2_keyboard

    0下载:
  2. FPGA PS2_keyboard VHDL 语言驱动-FPGA PS2_keyboard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.32mb
    • 提供者:liwenwen
  1. final-design

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  2. 利用verilog来实现一个右移的桶式移位寄存器-make a left shifting register in verilog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.32mb
    • 提供者:陈静波
  1. digtal_clock

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  2. FPGA实现数字钟VHDL语言编写,包涵整点报时,清零,调时调分等功能-FPGA digital clock VHDL language, includes the whole point timekeeping, cleared when the transfer function of adjusting grading
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.32mb
    • 提供者:sorghumho
  1. implementation-of-srrc-filter

    0下载:
  2. 这是基于国标DMB_TH中发端升余弦滚降滤波器中FPGA实现,包括滤波器的理论,DA算法和多相分布算法-This is based on GB DMB_TH the originator Raised Cosine Filter in FPGA, including the filter theory, DA algorithm and multi-phase distribution algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.32mb
    • 提供者:庄敏敏
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