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  1. DE2Code

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  2. 智能洗衣机控制器,能够实现洗衣,漂洗和脱水等功能,通过在DE2发板模拟实现.-Smart washing machine controller, to achieve laundry, rinsing and dehydration functions, DE2 development board through simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.73mb
    • 提供者:叶健
  1. 1-3

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  2. 基于altera de2 development an education board板的 例程1-3-altera de2 development an education board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.73mb
    • 提供者:cyp
  1. EDAdesign(4)

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  2. 该文件中是关于一些VHDL许多编程实例以及源码分析,希望对VHDL爱好者有用。卷4包括低频数字相位测量仪、电压控制LC振荡器
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.73mb
    • 提供者:shengm1
  1. nios2net

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  2. nios2实习的网络通讯,基于dm9000a芯片。在de2-70开发版上实习,内部附有所以源码,nios的源码放在software文件夹下面。-nios2 internship network communications based on dm9000a chip. Version of the de2-70 on the practical development of the internal source with it, nios software folder on the sour
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.73mb
    • 提供者:einstein
  1. eeprom_test

    0下载:
  2. eeprom读写,经典的iic接口,学习状态机的写法(read and write eeprom with iic interface)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-10
    • 文件大小:1.73mb
    • 提供者:konan007
  1. bist pattern generator

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  2. document of bist with low power generator
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-20
    • 文件大小:1.73mb
    • 提供者:vankay
  1. mutex_3to8_VHDLproject

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  2. 常用的VHDL模块,适合VHDL入门者,本系列一共包含六个VHDL模块,本模块是3-8译码器(mutex_3to8) 1.算术逻辑单元(alu_1706),实现算术逻辑运算 2.CPU寄存器组(cpu_register),实现四个通用寄存器(具有读写功能),一个PC寄存器(清零,置数,加一计数,减一计数,工作使能)。 3.全加器(full_adder) 4.半加器(half_adder) 5.3-8译码器(mutex_3to8) 6.计算机运算器(S6)实现运算器相关功能
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.73mb
    • 提供者:xiaobei
  1. MultHalfBand

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  2. 基于Matlab的FPGA数字半带滤波器设计-Matlab-based FPGA digital half-band filter design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:1.73mb
    • 提供者:liuguagnquan
  1. SOCKET

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  2. 基于de2开发板与pc机之间传输的实验,有详细的实验步骤和全面的资料,socket程序-De2-based development board and transfer between pc machine experiments, a detailed and comprehensive information on experimental procedures, socket program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.73mb
    • 提供者:郝蕾
  1. FPGA

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  2. FPGA最小系统的概念组成电路、常用接口和硬件系统的调试-The concept of minimum system composed of FPGA circuits, common interface and hardware system debugging
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.73mb
    • 提供者:zyl
  1. FPGA-design

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  2. 从零开始学习FPGA的最小系统。FPGA设计的很好才入门书籍。-FPGA from scratch to learn the smallest systems. FPGA design of a good book entry only.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.73mb
    • 提供者:胡晓伟
  1. lanqiujishiqi

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  2. 这是篮球计时器,vhdl源代码,包括12min倒计时,24sec倒计时-basketball game time paly.including 12min,24sec……
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.73mb
    • 提供者:zhuming
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