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  1. clock

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  2. Quartus II软件设计数字电子钟,使用verilog语言编写各个 模块生成symbol files,再用原理图方式制作顶层文件。 完成的功能有:能够显示时、分、秒;具有清零,调节分钟的功能; 具有整点报时功能,声响电路发出叫声; -failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:2.32mb
    • 提供者:
  1. project

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  2. 在Spartan-3E FPGA开发板上做的一个小项目--带语音功能的计算器,并且通过VGA接口在显示器上显示图形界面。涉及到ps2键盘模块,VGA显示模块,picoblaze汇编,串口收发模块。-In the Spartan-3E FPGA development board to do a small project- a calculator with voice capabilities, and VGA interface, through the graphical interfac
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.32mb
    • 提供者:赵龙
  1. EXAMPLES-BASED-ON-ISE-SOFTWARE

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  2. 一些简单的基于xilinx spartan-3的简单例程-Based on some simple xilinx spartan-3' s simple routines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:xia
  1. music_player

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  2. FPGA实现音乐播放器,蜂鸣器播音,LED点阵屏同步滚动显示歌词,与音乐同步效果好,按键控制播放、暂停、停止、重播。-FPGA realization of music players, broadcasting buzzer, LED dot matrix display screen, synchronized scrolling lyrics and music synchronization effect, buttons control play, pause, stop, repla
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.32mb
    • 提供者:顿河战神
  1. avalon_pwm

    0下载:
  2. altera公司的PWM设计,非常详细!-altera' s PWM design, very detailed!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:殷金坚
  1. 8253

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  2. 8253计数器接口电路 intel8253是NMOS工艺制成的可编程计数器/定时器,有几种芯片型号,外形引脚及功能都是兼容的,只是工作的最高计数速率有所差异-8253 counter interface circuit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.32mb
    • 提供者:keven
  1. channel_loss

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  2. 数字中频接收机,有助于您加深对多速率信号处理机中频数字接收机设计的理解-IF digital receiver can help U understand the principle of digital receiver.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-07-20
    • 文件大小:2.32mb
    • 提供者:张昉璞
  1. 12864

    0下载:
  2. lcd12864静态显示,不可实时显示数据。(The lcd12864 static display, cannot display the data in real time.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:2.32mb
    • 提供者:qwer_sun
  1. sin_generator

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  2. 基于QUARTUS ii的ROM的正弦方波锯齿信号发生器。-Sine square, wave saw and tooth signal generator based on ROM of QUARTUS II.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:
  1. FreeRTOS_Altera_SoC

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  2. FreeRTOS在altera最新推出的SOC系列的移植-FreeRTOS in altera latest SOC series of transplant
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:
  1. 2008812051513262

    0下载:
  2. 一些FPGA方面的资料与大家分享,介绍了FPGA的基础学习及算法,适合初学者-Some FPGA information to share with you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:ly
  1. dds

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  2. 这是本人在学校做的一个DDS信号发生器,频率相位可调。输入时钟50Mhz-DDS phase frequency adjustable Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:wen show
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