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  1. shudian

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  2. DDS信号源设计,通过频率控制字k可以自动调节波形频率的输出-DDS signal source design, frequency control word k can automatically adjust the frequency of the waveform output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:2.34mb
    • 提供者:longway
  1. lab2

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  2. 上传的文档以及代码是利用system generator来实现一些简单功能的实例,主要给system generator初学者一些参考-Here are some examples of entry-system generator, mainly for beginners some reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.34mb
    • 提供者:檀雨
  1. _QuartusII

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  2. 华为_QuartusII指南,华为_QuartusII指南华为_QuartusII指南-华为_QuartusII指南华为_QuartusII指南华为_QuartusII指南
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.34mb
    • 提供者:your name
  1. quartusIIshiyong

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  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.35mb
    • 提供者:cuihaifeng
  1. ellip-(1)

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  2. 基于FPGA的椭圆滤波器 采用VHDL语言 使用quartus仿真-Elliptic filter FPGA-based simulation using VHDL language quartus
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.35mb
    • 提供者:aaa
  1. cpu

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  2. 用VHDL写的一个cpu程序,可以在实验台上运行运行,包括各种基本的寻址方式,里面还含有每个模块的波形-Use VHDL to write a cpu program that can run on the bench run, including a variety of basic addressing modes, which also contains the waveform of each module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:2.35mb
    • 提供者:sherrytonger
  1. sdr sdram controller

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  2. ALTERA sdram vhdl与verilog参考设计-Altera SDRAM VHDL and Verilog reference design
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.35mb
    • 提供者:陈东平
  1. sdram-controller

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  2. 使用于FPGA上的通用sdram controller模块,用于在FPGA上实现sdram接口-Used in general sdram controller on FPGA module for the interface in the FPGA to achieve sdram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:2.35mb
    • 提供者:黄宸懿
  1. 0130811548Verilog

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  2. this verilog book-this is verilog book
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.35mb
    • 提供者:tan
  1. fj2j_example

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  2. 实现小波变换mallat算法2层分解,经测试完全正确。-Mallat implementation of wavelet transform decomposition algorithm for layer 2, the test is correct.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.35mb
    • 提供者:羽凡
  1. uvm-1.2.tar

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  2. Archive that shoul contain UVM_1.2
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-22
    • 文件大小:2.35mb
    • 提供者:za2920998
  1. FPGA

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  2. 一些常用的源程序,有IC2总线,万年历等5个源代码。希望能对各位有帮助。-Some common source, there IC2 bus, calendar and other 5 source code. Hope you can help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:2.35mb
    • 提供者:李李
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