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  1. IR_PEN

    0下载:
  2. infra pen controller, cmos sensor control and sdram control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:49.36kb
    • 提供者:byungchan
  1. tmds_decoder

    0下载:
  2. Tryout HDMI decoder for Xilinx-based boards, using SERDES logic. Different implementations.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:49.33kb
    • 提供者:inru
  1. vhdl_model.rar

    0下载:
  2. VHDL实例,各个方面均有,基本语法,状态机,汉明码,寄存器,步进电机控制器,表决器,多路选择器,译码器等等,VHDL model,include: basic grammer,moore mealy state machine,register,counter,multi,decoder,et..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:49.33kb
    • 提供者:Rainer
  1. spi

    0下载:
  2. 串行外部接口的ppt文档,有modelsim仿真波形,绝对有用。-Ppt serial external interface documentation, there modelsim simulation waveforms, absolutely useful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:49.32kb
    • 提供者:薛辉
  1. xapp1002

    0下载:
  2. xilinx利用chipscope调适PCIe Endpoint IP的说明文档与源文件。-xilinx use chipscope adjustment PCIe Endpoint IP for documentation and source files.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:49.28kb
    • 提供者:hanfei
  1. VHDL

    0下载:
  2. Basic introduction to VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:49.26kb
    • 提供者:mihal
  1. interrupt_controller

    0下载:
  2. 中断控制器电路verilog实现源代码,silicon验证的.-interrupt controller IP source code, APB interface.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:49.24kb
    • 提供者:moses lee
  1. SPI-IP

    0下载:
  2. 比较经典实用的ip核,对初学者有很大的帮助,语言比较简单。-Classic and practical IP core, a great help for beginners, the language is relatively simple.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:49.21kb
    • 提供者:张三
  1. KX_7C5TP

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  2. 康芯公司的KX_7C5TP实验板原理图。这个实验板很好用。希望这个原理图能给FPGA的初学者有所帮助。-Kang core company KX_7C5TP experiment board schematics. This experiment very well with the board. Hope that this will give FPGA schematic beginner help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:49.21kb
    • 提供者:张阳
  1. clock_timer

    1下载:
  2. 数字电子钟实现了真实的时间计数,通过这个工程的训练,能更好的了解Quartus II数字电路开发的过程。--Digital electronic clock to achieve a real time count, the training through this project, to better understand the Quartus II development process of digital circuits.-
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:49.2kb
    • 提供者:臧文渊
  1. FPGA_experience

    0下载:
  2. VHDL设计的经验,高人手记,让你在编写VHDL代码时避免不应用的错误和修改错误。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:49.19kb
    • 提供者:chendsh
  1. risc8

    0下载:
  2. 8 bit risc code with verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:49.17kb
    • 提供者:richard
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